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Le Capacità Integrate del DFM dell'Incontro Consegna il Flusso Faccia A Faccia Completo per Flusso di Riferimento di STARCAD-CEL V3.0

Published on July 8, 2009 at 9:03 PM

Cadence Design Systems, Inc. (NASDAQ: CDNS), la guida nell'innovazione globale di progettazione, annunciata oggi il consorzio Giapponese STARC (Centro della ricerca a semiconduttore di Ricerca Accademico di Tecnologia dei Semiconduttori), ha integrato il Sistema di Implementazione di Cadence® Encounter® Digital, con le sue tecnologie integrate di DFM, poichè i sui DFM scorrono mirando a 45 progettazioni di nanometro e sotto. La serie completa di DFM integra l'Analizzatore Fisico di Litho di Cadenza (LPA), il Preannunciatore del CMP Elettrico dell'Analizzatore (LEA) e di Cadenza di Litho di Cadenza nella cabina di pilotaggio del progettista. Facendo Uso della Cadenza permessa a Flusso di Riferimento di STARCAD-CEL V3.0, accesso immediato di guadagno dei progettisti ad informazioni trattamento-accurate di fabbricazione presto nel flusso di progettazione fisica, dove gli ingegneri possono fare leva l'integrazione senza cuciture nell'implementazione digitale per identificare, analizzare e correggere rendimento-limitazione dei hotspot per le loro progettazioni di avanzato-vertice. Inoltre, con l'Analizzatore Elettrico di Litho, i progettisti possono analizzare l'impatto di litho sulla prestazione del transistor e fare le alternanze di progettazione necessarie per rispondere ai loro criteri di dimensionamento.

“Il nuovo Flusso di Riferimento di STARCAD-CEL V3.0 indirizza le preoccupazioni critiche di progettazione-per-fabbricazione per 65nm, 45 nanometri e tecnologie della trasformazione avanzate,„ ha detto Nobuyuki Nishiguchi, il Vicepresidente ed Il Direttore Generale, il Dipartimento 1 dello Sviluppo a STARC. “Il Sistema di Implementazione di Digital di Incontro di Cadenza con l'Analizzatore Fisico di Litho ha fornito la rilevazione di hotspot di litho e la correzione e una correzione molto accurate di cento per cento del catastrofico o del rendimento che limita i difetti nella nostra progettazione della prova, mentre però fornendo un tempo complessivo più veloce.„

L'Analizzatore Fisico di Litho di Cadenza sfrutta la concentrazione delle capacità di trattamento di parallela multi-CPU, con il proprietario, gli algoritmi fondamentali consegnanti la scalabilità lineare della prestazione ed il tempo complessivo più veloce come riferito da STARC. Con gli avanzamenti multipli nella modellistica e nell'integrazione trattate della tecnologia con la Cadenza Virtuoso® IC Su Ordinazione e Piattaforme di Implementazione di Digital di Incontro, la Cadenza fornisce una soluzione digitale completa di implementazione “di corretto-da-progettazione„ per la cella/blocco al interamente chip.

“L'industria e l'ecosistema a semiconduttore riconosce le tecnologie di Cadenza DFM poichè essenziale alle metodologie di progettazione avanzate oggi,„ ha detto il Dott. "chi"-Ping Hsu, vice presidente senior di ricerca e sviluppo digitali di implementazione a Cadenza. “È la differenza fra l'identificazione delle emissioni potenziali di DFM durante la fase di progettazione ed il fissatore loro giuste là nel sistema, contro la scoperta del rendimento che limita i difetti durante il processo di fabbricazione, quando è troppo tardi. Siamo fieri lavorare molto attentamente con STARC per provare i vantaggi della nostre tecnologia di DFM e soluzione digitale di implementazione per il loro flusso di progettazione di riferimento di nanometro 45.„

Le società A Semiconduttore universalmente ora stanno richiedendo l'analisi di DFM durante la fase di progettazione e la maggior parte delle 20 società principali a semiconduttore ora ha adottato le soluzioni del DFM della Cadenza per incontrare i loro scopi di accuratezza, della prestazione e del rendimento.

Last Update: 14. January 2012 00:22

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