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遭遇の統合された DFM の機能は STARCAD-CEL V3.0 Ref の流れのための完全なエンドツーエンドの流れを提供します

Published on July 8, 2009 at 9:03 PM

Cadence Design Systems、 Inc. (NASDAQ: CDNS は)、今日発表される全体的なデザイン革新のリーダー日本の半導体の研究の借款団 STARC (半導体技術の学術の研究所)、 Cadence® Encounter® デジタルの実施システムを、統合された DFM の技術と統合しま DFM が流れるので、 45 のナノメーターデザインを以下に目標とします。 広範囲 DFM の組はデザイナーの操縦室に調子の (LPA) Litho の物理的な検光子、調子の (LEA) Litho の電気検光子および調子 CMP のプレディクタを統合します。 調子を使用して可能になった STARCAD-CEL V3.0 Ref の流れ、エンジニアが識別するためにデジタル実施のシームレス統合にてこ入れできる物理的設計の流れのプロセス正確な製造業情報へのデザイナー利得の準備されたアクセスは早く彼らの高度ノードデザインのためのホットスポットを収穫限定することを分析し、訂正します。 さらに、 Litho の電気検光子と、デザイナーはトランジスターパフォーマンスの litho の影響を分析し、彼らの設計基準を満たすために必要な設計トレードオフを作ることができます。

「新しい STARCAD-CEL V3.0 の参照の流れ 65nm についての重大なデザインのため製造業の心配をアドレス指定します、 45 ナノメーターおよび進められた加工技術」、は Nobuyuki Nishiguchi、副大統領および総務部長、 STARC の開発部 1 を言いました。 「またより速い送受反転時間を提供している間」。は Litho の物理的な検光子が付いている調子遭遇デジタル実施システム私達のテストデザインの欠陥を限定する破局的のか収穫の非常に正確な litho のホットスポットの検出および訂正および百% 訂正を提供しました

調子の Litho の物理的な検光子は STARC によって報告されるように線形パフォーマンススケーラビリティおよびより速い送受反転時間を提供する所有物、基礎的なアルゴリズムと共に複数の CPU 並行処理の機能の強さを、利用します。 調子の Virtuoso® の習慣 IC および遭遇のデジタル実施のプラットホームとのプロセス模倣および統合多重テクノロジーの進歩と共に、調子は全チップにセル/ブロックに完全な 「正しによデザイン」デジタル実施の解決を提供します。

「高度の設計方法論に必要今日」、はので半導体の工業および生態系調子 DFM の技術を認識します先生を調子のデジタル実施の研究開発の上席副社長言いましたキー Ping Hsu。 「それは余りに遅いとき設計段階の間の潜在的な DFM 問題をそこに識別し、製造工程の間に欠陥を限定する収穫の検出対システムで修復することの違い、右のです。 私達は STARC を密接に使用して自慢しています彼らの 45 ナノメーターの参照デザイン流れのための私達の DFM の技術およびデジタル実施の解決の利点を証明するために」。

世界的の半導体の会社は設計段階の間に今 DFM の分析を必要として、上の 20 人の半導体の会社の大半は今正確さ、パフォーマンスおよび収穫の目的を達成するために調子の DFM の解決を採用してしまいました。

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