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在标准 CMOS 进程的永久 NVM 消灭对另外的在传统解决方法需要的屏蔽和处理步骤的需要

Published on July 21, 2009 at 7:46 AM

Virage Logic Corporation (那斯达克:VIRL),半导体行业的委托的 IP 合作伙伴,今天宣布它在台湾积体电路制造公司提供嵌入固定存储器最清楚的 (NVM)投资组合,当完全合格的 IP 解决方法范围从 250nm 下来对 65nm。 可编程序多时间和少量时间可编程序的 NVM (MTP) IP 的一个全面 (FTP)的选择, AEON® 产品系列处理无线,汽车,模式,功率管理和证券应用的需要。 永久被开发了使用在不要求另外的屏蔽或处理步骤的一个标准 CMOS 进程的证明的浮动门技术。 永久支持从 8 的密度到 16k 位并且是多个时间可编程序至 100k 循环。

“我们高兴地维护与 Virage 逻辑的一家长年的合伙企业,因为公司的 IP 解决方法在各种各样的台湾积体电路制造公司 CMOS 进程中支持 NVM 产品下来对 65nm”,说丹 Kochpatcharin, IP 在台湾积体电路制造公司的投资组合市场营销的副主任。 “我们的客户由消色力、区和费用有益于,当在外部 EEPROM 解决方法时的增长的数据安全性,当使用 Virage 逻辑的 NVM 产品提供可用为台湾积体电路制造公司的进程时”。

Virage 逻辑的永久 MTP 内存在超过一十亿个集成电路 (集成电路) 迄今被发运了和被准许了给主导的客户包括模拟装置、线性技术、硅图象、新帝公司和 Avago。

“其他公司没有提供编号的一标准基于 CMOS 的嵌入 NVM 提供 - 架子 - 配置或处理节点覆盖范围作为 Virage 逻辑的 NVM 投资组合”,说 Yankin Tanurhan 博士,解决方法, Virage 逻辑副总统和总经理, NVM。 “永久有超过 600 种不同合格的配置和被开发了并且硅证明在范围从 250nm 的处理节点下来对 65nm,与 40nm 以下当前在开发中”。

当 Virage 逻辑的广泛产品提供,客户有集成多个时间可编程序的 NVM 的灵活性的更多选项到他们的设计无线,模式,功率管理和证券应用的。 需要高可靠性的设计员使用 Virage 逻辑的 NVM MTP 功能执行周到电子测试和改进整体集成电路测试覆盖范围和证券,并且加密设计员使用它使整个系统稳健攻击。

提供在外部一次性可编程序的解决方法的可靠性和性能 (OTP)福利,永久也起一个支持因素作用对于新的功能和功能在设计。 无线集成电路有嵌入内存电子减少 NVM 的电力消费按 50% 到 80% 在外部可拭写可编程可读存储器 (EEPROM)。

充分的描述特性和鉴定数据为 Virage 逻辑的 NVM 为合格客户根据需要是可用的。 对特定处理可用性或请求硅描述特性报表,联络 Virage 逻辑。

Virage 逻辑将是一个特色合作伙伴在台湾积体电路制造公司的开放创新 Platform™摊 (#822) 在被暂挂 2009年 7月 (DAC) 27-30,在 Moscone 会议中心的设计自动化会议在旧金山,加利福尼亚。

Last Update: 13. January 2012 18:02

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