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지도자 도표는 TSMC 참고 교류 10.0에서 포함된 공구와 기술을 확장합니다

Published on July 23, 2009 at 8:18 PM

Mentor Graphics Corporation (NASDAQ: MENT는) 오늘 TSMC 참고 교류 10.0에서 포함된 지도자 공구와 기술의 세트를 확장했다는 것을 알렸습니다. 확장한 Mentor® 대위 지원은 배치 알고 있는 시험 실패 진단을 위한 Calibre® 편재하는 물리적인 검증을 가진 28nm IC, 더 단단한 통합을 위한 실시netlist 에 GDSII 복잡한 IC를 위한 기능적인 검증을, 및 DFM 플래트홈 및 공구 진행했습니다. 추가적으로, 이 새로 소개한 지도자 대위는 또한 기능적인 검증, IC 실시 및 IC 테스트를 위한 지도자 공구를 가진 낮은 힘 디자인을 제시합니다.

"지도자 도표 그것의 참고 교류 시스템 레벨에서 기능적인 검증, 장소 및 경로, 물리적인 검증 및 실리콘 시험을 통해서 총 IC 디자인 주기 커버하기 위하여 제물을 확장하는 것을 계속합니다, 뿐 아니라 낮은 힘 제조 가변성 및 실리콘 수확량 분석과 같은 제안 새로운 해결책,"는 S.T. Juang를 TSMC에 디자인 기반 매매의 고위 디렉터 말했습니다.

참고 교류 10.0 지도자 대위는 TSMC 참고 교류에 있는 첫번째 지도자 실시 해결책을 포함하여 많은 지역에 있는 새로운 기능을, Olympus SoC™ 장소 및 경로 시스템 제공합니다. 향상된 IC 실시를 위해, Olympus SoC 시스템에는 새로운 특징이 에 칩 변이, 28nm 여정 및 낮은 힘 디자인을 제시하는 있습니다:

  • 향상된 단계 기지를 둔 OCV 분석 및 최적화 - 다른 단계 기지를 둔 OCV를 놓아서 도움을 감소시키고 염세 사상을 가능하게 합니다 더 단단 디자인 마감을 평가합니다.
  • N28 여정은 지배합니다 - 28nm 투명한 반 마디를 위한 지원을 포함하여 교류netlist 에 GDSII 완전한 것을 28nm 지원을, 제공합니다.
  • 힘 도메인 - 지원 혼잡을 극소화하고 계층구조 변경을 위한 필요를 감소시키는 동일 전압 도메인에 있는 다중 평면도를 관절을 삐게 하십시오.
  • UPF 계층적인 낮은 힘 자동화 - 디자이너에게 더 중대한 융통성을 주는 UPF 기지를 둔, 저전력 디자인을 포괄기도 하고 상향식 지원을 제공합니다.

Olympus SoC와 구경 플래트홈 내의 디자인 를 위해 제조 기능은에와 저쪽에 제조 가변성 문제점을 28nm 해결하기 위하여 확장되고 더 단단하게 통합되었습니다:

  • Litho 핫스팟 고치는 - Olympus SoC 장소 및 경로 공구를 자동적으로 구경 LFD™ 공구에 의해 검출된 litho 핫스팟을 고치는 가능하게 해서 수확량을 향상합니다.
  • 시기를 정하고는 및 ECOs를 위한 DMx 충분한 양의 빠른 컨버전스 - Olympus SoC 시스템은 (TSMC의 VCMP 시뮬레이터로 작동하는) 구경 CMPAnalyzer 타이밍에 대한 그것의 충격을 위한 간격 변이를 분석하기 위하여 공구 빕니다. Olympus SoC 공구는 또한 중요하게 수확량을 향상하고 염세 사상을 감소시키는 계층, 점증형의 및 타이밍 몬 금속 충분한 양 교류를, 지원합니다.
  • 세포 색인 알고 있는 배치 - 어려운 핀 접근을 가진 세포를 위한 추가 룸을 할당해서 수송하는 혼잡과 속도를 감소시킵니다.
  • 전기 DFM - 구경 CMPAnalyzer 구경 xRC™ 및 제품은 시뮬레이트한 간격 정보가 기생하는 적출 결과로 정확한 회로 시뮬레이션을 몰기 위하여 통합되는 것을 허용하도록 통합됩니다. 이것은 또한 능률적인 코너 시뮬레이션을 해결책 및 지도자 Eldo® 회로 시뮬레이터에 통계적인 기생하는 정보를 제공해서 통계 분석을 제공합니다.

추가적으로, 참고 교류 10.0에 있는 포장 디자인에 있는 제 2 그리고 3D 시스템의 구경 nmDRC 및 구경 nmLVS (SIP) 제품 지원 방송 종료 물리적인 검증.

참고 교류 10.0는 더 나은 결함 검출, 힘 알고 있는 테스트 및 실패 진단을 위한 TestKompress®와 YieldAssist™ 제품에 있는 새로운 특징을 포함합니다:

  • 내재되어 있던 배수는 ATPG - 패턴 규모 시험 시간에 있는 어떤 증가도 없는 증가 브리지 결함 검출을 검출합니다.
  • 배치 알고 있는 진단 - 틀린 브리지/열려있는 용의자를 삭제하고, 진단 해결책을 강화하고, 효과적인 수확량 분석을 위한 기초를 건설합니다.
  • 저전력 ATPG - 기존 시계 문의 일정하 충분한 양 감압 장치 그리고 힘 알고 있는 통제를 이용하는 검사 시험의 모든 단계 도중 힘을 감소시킵니다.

참고 교류 10.0는 또한 Questa®에서 향상된 기능적인 검증 특징을 포함하고 복잡한 IC의 향상한 타당성 검사를 위한 0-In® 플래트홈은 디자인합니다.

  • IEEE Std. 1801-2009™ UPF와 IEEE Std. 1800-2005™ SystemVerilog를 위한 지원을 특색짓는 기준 기지를 둔 해결책.
  • 디자인 교류에서 향상된 힘 관리 회로를 일찌기 검증하는 형식적인 기능 및 통합 저전력 시뮬레이션.
  • 복잡한 시계 도메인 교차점의 정체되는 동적인 검증은 표준과 낮은 힘 최빈값에 있는 올바른 작동을 지키기 위하여 순회합니다.

"TSMC의 참고 교류 10.0에 있는 완전한 지도자 디자인 에 실리콘 대위 저희가 우리의 상호적인 고객'는 낮은 힘 디자인을 포함하여 28nm를 위한 큰 도전, 제시하는 것을 허용하고 검증, 대규모 SoC 실시, 제조 가변성 및 비용 효과적인 시험 및 수확량 분석,"를 Walden C. Rhines, 의장 및 CEO 의 지도자 도표를 말했습니다. "28nm에 기업 전환은 또한 제출합니다 지도자가 해결할 유일한 위치에서 인 새로운 기술적인 도전을 가공합니다. TSMC를 가진 우리의 가까운 협력은 저희가 고성능 및 더 중대한 신뢰도로 더 단단 시장에 내놓기 위하여 우리의 고객이." 그들의 제품을 얻을 것을 돕는 공구를 가진 디자이너와 주조 사이 루프를 닫는 것을 허용합니다

Last Update: 14. January 2012 02:24

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