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ARM et Cadence collaborent pour Activer IP de nouvelle génération physique pour IBM SOI 45nm

Published on July 27, 2009 at 8:43 AM

Cadence Design Systems, Inc (NASDAQ: CDNS) , leader en innovation pour la conception électronique, ont annoncé aujourd'hui qu'ils ont validé une nouvelle génération de bibliothèques ASIC d'ARM utilisant le Cadence ® Encounter ® System Application numérique ciblant IBM de 45 nanomètres de silicium sur isolant processus de fabrication (SOI). Le développement constitue un autre jalon dans une collaboration pluriannuelle permettant une utilisation efficace d'IBM de faible puissance, haute performance technologie SOI pour les conceptions de prochaine génération.

«Notre collaboration avec Cadence sur la validation précoce de leurs outils assurera la préparation de conception pour des clients d'IBM la technologie SOI 45nm. Collectivement, ARM, Cadence et IBM proposent une plate-forme de conception fiables où la vitesse, la fonctionnalité et faible consommation d'énergie sont nécessaires", a déclaré Tom Lantzsch, vice-président, division de physique IP d'ARM. «Ces nouveaux silicium validé 45nm SOI bibliothèques permettent la création de SOC économe en énergie, tout en réduisant les temps de développement et de coût."

L'ARM 45nm SOI bibliothèques ont été développées en utilisant la cadence Virtuoso ® plateforme de conception personnalisée 6,1 et validé sur plusieurs modèles dans le système de mise en œuvre rencontre de cadence numérique, une complète RTL-à-GDSII environnement de conception que les caractéristiques du format Puissance Si2 commune (PCF) à faible conception de la puissance, natif signoff-en-the-loop pour l'extraction de l'interconnexion, le timing, la puissance et l'intégrité du signal, plus entièrement intégrée conception pour fabrication de Cadence (DFM) technologies. L'ensemble de Cadence de bout en bout la conception, la mise en œuvre, et la solution de vérification est prouvé à soutenir pleinement le processus de fabrication SOI.

«La collaboration entre Cadence, ARM et IBM est essentiel pour les concepteurs de cibler notre technologie SOI", a déclaré Richard Busch, directeur, Produits IBM ASIC. "Il est impératif que ces bibliothèques sont conçues, vérifiées et mises en œuvre en étroite corrélation à notre processus de SOI pour les concepteurs peuvent réaliser les pleins avantages de la hausse des performances et faible consommation d'énergie par rapport aux technologies CMOS en vrac».

«Nous sommes ravis de jouer un rôle vital dans cette collaboration pour offrir avancés SOI solutions prêtes à la communauté du design à un moment où la capacité d'adapter les performances et les exigences de puissance sont une préoccupation croissante», a déclaré le Dr Chi-Ping Hsu, vice-président senior de la recherche et de développement pour le groupe de mise en œuvre chez Cadence. «En tant que chef de file dans la conduite des solutions avancées de faible puissance, la collaboration avec d'autres dirigeants du Consortium SOI permet le déploiement rapide de haute performance complète et les technologies économes en énergie de processus intégré avec des méthodologies de conception standard de l'industrie."

Last Update: 17. October 2011 14:53

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