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Freescale Semiconductor sucesso Taped Out 45 nanômetros Design de Networking

Published on July 28, 2009 at 9:00 AM

Cadence Design Systems, Inc. (NASDAQ: CDNS) , líder em inovação de design eletrônico global, anunciou hoje que Freescale Semiconductor, com sucesso, gravou um projeto de rede de 45 nanômetros usando o Cadence "corrigir-by-design" de prevenção, análise, implementação e solução para signoff mais rápido, mais previsível produção time-to-volume. O fluxo incorpora líder da indústria baseada em modelo design para manufatura (DFM) a análise, prevenção e signoff, incluindo Analyzer Litho Cadence Física, Predictor CMP Cadence, Analyzer Litho Cadence Elétrica, Extração QRC Cadence, e baseado em modelos de otimização de roteamento com o Cadence ® ® Encontro de Implementação Digital (EDI) do sistema. Esta metodologia demonstrou perfeita o tempo de resposta significativamente mais rápido em comparação com soluções tradicionais DFM e foi usado para gravar o projeto para Chartered Semiconductor Manufacturing.

"Para um grande volume projetos usando nós de processo avançados, nós acreditamos que é um factor essencial e diferenciador para ter silício precisas análise e implementação de rendimento crítica passos, como litografia e CMP", disse Kyle Patterson, gerente de DFM Technologies em Freescale semicondutores. "Ao incorporar técnicas DFM Cadence avançados, tanto física e elétrica, para a implementação, somos capazes de prever com precisão as questões de produção e impedir que elas ocorram, e com uma metodologia que leva uma fração do tempo em relação aos métodos tradicionais DFM. Fundamentalmente, este permite-nos acelerar o nosso time-to-market e time-to-volume-requisitos. "

Através de colaborações com empresas líder de semicondutores, como Freescale, Cadence tem desenvolvido um da indústria do DFM análise mais completa de prevenção e metodologias signoff, permitindo projetar lado otimizações que reduzem o risco de fabrico. Cadence alavancar soluções de processamento multi-core distribuídos de forma transparente endereço ciclo de projeto aumentando e aumenta o tamanho do banco de dados em 45 - e nós de 32 nanômetros processo e comprovadamente fornecem escalabilidade quase linear. Além disso, Analyzer Litho Cadence elétrica é o primeiro da indústria elétrica DFM solução (eDFM) em uso em empresas líderes de semicondutores de 90 nanômetros para 40 nanômetros, e atualmente está facilitando 32 - e 28 nanômetros variabilidade-aware desenvolvimento da biblioteca.

"Nossa visão coletiva é de modelar com precisão os efeitos de fabricação e resolvê-los durante a fase de projeto", disse Dr. Kuang-Kuo "KK" Lin, gerente sênior de Serviços DFM na Chartered. "Ao trabalhar com a Cadence para desenvolver modelos de silício com precisão de DFM para análise e implementação digital, nós produzimos um fluxo de DFM com benefícios distintos para Freescale, o que resulta em ciclos mais rápidos."

"A complexidade do projeto e orçamentos rigorosos de fabricação em 45 - e 32-nanômetros exigem colaboração inicial de três vias entre o cliente, a fundição ea EDA, começando no nível de biblioteca", disse Dave DesHarnais, diretor do grupo de Soluções de Implementação Digital da Cadence. "Estamos contentes que a nossa tecnologia de silício comprovada permitiu o sucesso da Freescale projeto e estamos ansiosos para assegurar seu sucesso contínuo fechamento design. Cadence vai continuar a investir para ser um fornecedor líder de todo o fluxo de execução de fabricação-aware".

Last Update: 18. October 2011 14:46

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