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Cadence公司推出高級台積電過程中實現高端的SoC設計的性能和集成

Published on September 29, 2009 at 7:46 PM

Cadence設計系統公司(納斯達克股票代碼:CDNS) ,在全球電子設計創新的領導者,今天宣布,Cadence的物理驗證系統採用40納米設計的新的可互操作的物理驗證格式,國際發展研究中心組成的檢查規則設計和ILVS佈局與原理圖檢查,由台灣半導體製造公司(TSMC)的開發。台積電這些新格式的Cadence的支持建立在先前宣布的Cadence的QRC IRCX文件格式的寄生提取的支持。這種物理驗證和寄生參數提取和分析能力相結合,確保 Cadence的客戶使用台積電的納米工藝,以提高矽產量的準確和一致的製造業數據的持續可用性。

國際發展研究中心和ILVS格式,方便先進的設計規則和設備提取必要的能力,以確保在台積電的先進工藝實施設計的完整性。使用一個共同的規則格式,確保準確性和結果是一致的陳述,無論物理驗證解決方案,每個客戶選擇的。

“Cadence公司和台積電已經在國際發展研究中心,ILVS和IRCX合作,用戶的Cadence的物理驗證系統和QRC寄生提取已及時訪問矽精確的檢查今天的納米流程,和的過程中幾代人超越,”說湯姆泉,台積電設計服務營銷的副主任。 “新的統一的數據格式是台積電開放創新平台™提供設計人員能夠選擇最佳的一流的EDA工具,以配合他們的設計的需求,並提高設計精度首次流片成功的一部分。”

,核查組在Cadence的研究和開發的副總裁,博士說:“拉希德Salik:”採用新的台積電 IDRC和ILVS規則甲板格式進程的數據源接近的Cadence物理驗證系統的先進功能。 “這樣的組合,確保我們能夠提供準確的結果,與快速的周轉時間。我們有信心,繼續加強我們與台積電的關係將帶來實實在在的利益,價值和選擇,以我們共同的客戶。“

IDRC和ILVS在Cadence物理驗證系統的支持,並 IRCX在Cadence的QRC提取技術的支持,此外,與 Cadence的數字和定制設計流程提供完整的集成,因此,從一個單一的提供一個前端至後端的設計和簽收流EDA供應商。該產品有利於“的工具之一,一個甲板”數字和定制設計,最大限度地減少支持開銷模型。

Last Update: 3. October 2011 04:26

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