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SMIC は 65 のパフォーマンスの圧力そして石版可変性を予測するために調子の解決を採用し、 - 45 nm 半導体は設計します

Published on October 19, 2009 at 4:18 AM

Cadence Design Systems、 Inc. (NASDAQ: CDNS)、今日その Semiconductor Manufacturing International Corporation (「SMIC」発表される全体的な電子デザイン革新のリーダー、; NYSE: SMI および SEHK: 0981.HK は) 調子を採用しました (R) Litho の物理的な検光子そして調子の Litho の電気検光子はへのより正確に圧力の影響および 65 のパフォーマンスの石版可変性を - および 45 ナノメーターの半導体デザイン予測します。 調子の Litho の電気検光子 -- 90 ナノメーターからの 40 ナノメーターへの一流の半導体の会社の生産の半導体工業の最初電気 DFM の解決 -- 正確に最終的なケイ素を予測した流れを作成するために調子の Litho の物理的な検光子と結合されて生じます。

以前は、個々のセルの電気動作およびライブラリは目標とされた加工技術に基づいてある特定のデザインに一貫して適用できる単一の文脈で前特徴付けることができます。 65 ナノメーターで以下に、セルの各配置は近隣のセルか環境に関連して物理的な、電気可変性の自身のセットを作成します。 この 「文脈依存した可変性」はチップが失敗しますことができる深刻な問題として現れています。 調子の遭遇 (R) デジタル実施システム (EDI) システムは完全なチップ実施前に継ぎ目無くセルの厳密な文脈依存した物理的な、電気サインオフのための Litho の物理的な検光子そして Litho の電気検光子を両方統合します。 完全なチップの製造業の収穫を増加するために標準セルライブラリ、 (DFM)知的財産のコアおよび完全なチップの品質そして信頼性を改善する製造技術 (IP)のための流れのてこ比のモデルによって基づく物理的な、電気デザイン。

「65 のそして 45 ナノメーターで物理的な、電気変化をアドレス指定する必要セルの開始がデザインの全体の文脈を水平にし、考慮する全体アプローチを」、は言いました最大劉、 SMIC のデザイン・サービスの中心の VP を必要とします。 「調子 DFM と流れて下さい、私達はセルおよび IP の可変性を分析し、正確に実質のケイ素の彼らのパフォーマンスを模倣できます。 可変性を特徴付け、減らすことによって、私達の顧客は警護バンディングを減らし、良質のケイ素を作り出せます。 解決はまた全チップ電気 DFM 確認の流れに必要」。であるほぼ線形スケーラビリティを可能にします、

調子は遭遇のデジタル実施システムとのデザイン側の最適化を含む企業の最も完全なデザイン側面 DFM の防止、分析およびサイン・オフ方法の 1 つを、開発しました。 それはまた可変性のの模倣のために 32 の - そして 28 ナノメーターライブラリ使用されています。 「速い、石版印刷および圧力の両方効果のためのセルの正確な文脈依存した可変性の模倣は 65 ナノメーターで生産価値があるデザインの実行に主です以下に」、先生を調子の実施のグループのための研究開発の上席副社長言いましたキー Ping Hsu。 「多数の最初ケイ素の成功既に証明してしまいました大量の半導体デザインのための DFM の分析ツールの値を」。は

Last Update: 13. January 2012 12:02

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