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El NEC Adopta el Sistema de EDI de la Cadencia para los 40 Diseños Marginales del nanómetro ASIC

Published on January 26, 2010 at 12:58 AM

Cadence Design Systems, Inc. (NASDAQ: CDNS), el arranque de cinta en la innovación electrónica global del diseño, y Corporación de NEC Electronics (EET: 6723), un proveedor de cabeza de las soluciones del semiconductor, hoy anunciado que NEC Electronics ha adoptado el Sistema de la Puesta En Vigor de Cadence® Encounter® (EDI) Digital y ha tenido éxito en más de diez diseños de ASIC del complejo que apuntan su tecnología de proceso de CB40L (energía baja de 40 nanómetros) con varios diseña sujetado con cinta adhesiva con éxito fuera ya.

Utilizando más de 20 millones de entradas, la escala de nuevo Asics ha aumentado en dos a los cuatro-tiempos sobre los diseños anteriores que apuntaban 55 90 (nm) del nanómetro de proceso tecnologías del nanómetro y. El tramitación con hilos múltiples de los Sistemas de EDI, netlist--netlist a la compilación, y el análisis de aprobación integrado de la optimización y del cronometraje de DFM, aerodinamizaron los procesos de diseño grandes de ASIC.

“Nos satisfacen muy que el Sistema de EDI de la Cadencia es completo capaz de abordar nuestros retos delanteros del diseño del borde,” dijimos a Akira Denda, Jefe de Servicio del Departamento del Revelado de la Plataforma del Dispositivo, 1ra División de la Planificación de Empresas del SoC en la División de NEC Electronics ASIC. El “Sistema de EDI nos activó al tapeout un diseño área-eficiente mientras que el tiempo-a-mercado de mantenimiento leveraging la solución de punta a punta, con hilos múltiples.”

El Sistema de EDI de la Cadencia es un alto rendimiento configurable y extensible, alta capacidad, solución escalable del diseño para el diseño electrónico de alta densidad.

Cuanto más grande un diseño de ASIC llega a ser, más las variables se pone de pie de la manera de puesta en vigor correcta. El Sistema de EDI y sus componentes claves, incluyendo Sistema de Cronometraje del Encuentro y Compilador del Encuentro RTL, combinan para traer previsibilidad nuevamente dentro de la ecuación, dando por resultado un silicio más de alta calidad. Al mismo tiempo, la capacidad del multiprocesamiento del sistema integrado activado sobre 20 diseños de la millón-entrada ser entregado con pequeño aumento en tiempo de vuelta. Además, los representantes técnicos pueden realizar ahorros importantes de la potencia y rendir el aumento con técnicas avanzadas del diseño y de optimización de la energía baja.

El Sistema de EDI también proporciona a un flujo completo, constante, y convergente para dirigir los efectos (DFM) de la diseño-para-fabricación y de la variabilidad (litografía, CMP, termal, y variaciones del proceso) en los primeros tiempos del flujo del diseño. Integrando DFM modelo-basado y tecnología estadística en un flujo completo de la prevención-análisis-reparación, la solución de la Cadencia es capaz de manejar diseños enormes y proporciona a avances importantes de la productividad sobre soluciones tradicionales del DFM-cierre.

“El Sistema de EDI de la Cadencia proporciona a productividad importante mejorada y el tiempo-a-mercado, mientras que reduce el costo y arriesga asociado con diseño avanzado del semiconductor,” dijo al Dr. Ji-Silbido de bala Hsu, vicepresidente de la investigación y desarrollo de la puesta en vigor en la Cadencia. “El Sistema de EDI activó la cinta-fuera de NEC Electronics sus 40 diseños del nanómetro ASIC, implicando la integración increíblemente compleja sobre de 20 millones de entradas en un dispositivo único, de baja potencia, área-eficiente. Nos alineamos ya para ejecutar diseños avanzados adicionales del nodo con NEC Electronics, usando el Sistema de EDI con capacidades avanzadas del nodo para alcanzar convergencia rápida, fiable del diseño.”

Last Update: 13. January 2012 05:58

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