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Tech Papers Bewerten Advanced Technologies für den Einsatz neuer III-V-Materialien

Published on April 2, 2010 at 7:19 PM

Mit Blick auf finanzielle Zwänge und schweren technischen Herausforderungen, die Halbleiter-Industrie muss die kreative Zusammenarbeit der Praxis, um zu überleben, zu wachsen und Link zur neu entstehenden Industrien, SEMATECH , sagte Präsident und CEO Dan Armbrust in einer aktuellen Keynote SEMATECH 2010 Fläche Vorbereitung und Reinigung Conference (SPCC) in Austin, TX.

"Unser Erfolg als Industriestandard wird, wie gut wir in kollaborative F & E-Innovationen angewiesen", sagte Armbrust. "Wir müssen führend in der Anwendung Halbleiter-Fähigkeiten, um neue Technologien sein."

Armbrust sagte, dass während der gesamten Wirtschaft scheint sich zu verbessern, die Chip-Industrie, mit der Konsolidierung auseinander setzt, steigende F & E-Kosten, Abflachung Umsatzwachstum und zunehmend schwierigen technischen Ziele. Unter diesen Voraussetzungen Kooperationen werden zunehmend als eine notwendige und kostengünstige Business-Strategie angenommen, stellte er fest.

"Collaboration ist der Weg zum Überleben und Wachstum in einem sich verändernden Branche", sagte Armbrust rund 150 Konferenzteilnehmer. "Die Herausforderungen sind global und quer durch Branchen-Lösungen sind erhebliche Investitionen erforderlich und Leveraged Finanzierung Wir müssen neue Experimente in kreativer Zusammenarbeit zu fördern -... Interdisziplinäre und interregionale Kooperationen zwischen Industrie und Universitäten-Government-Allianzen, und die Konvergenz mit neuen Technologien und Branchen"

Armbrust, sagte der Halbleiter-Industrie hat eine gemeinsame Vorreiter gewesen, Bildung von Konsortien zu Ressourcen, Kosten und Risiken zu teilen, den Aufbau einer Industrie-Roadmap, halten Foren für die Industrie den Dialog und die Konsensbildung und die Schaffung von Standards und Infrastruktur für die großen Technologie-Übergänge.

"Aber wir können noch mehr tun," erklärte er, durch die Erforschung neuer Wege zur universitären Forschung in die Industrie Mainstream zu bringen, die Entwicklung neuer Partnerschaften zwischen Chipherstellern und Ausrüstung und Materialien Herstellern zur Kommerzialisierung zu beschleunigen und bilden Kooperationen mit neuen Branchen in der Nanoelektronik, Energie, und Biotechnologie.

"Halbleiter sind die Grundlage dieser neuen Industrien", sagte Armbrust. "Silicon Fertigung können nanodevice Herstellung angewendet werden. Unser Material Wissen bezieht sich auf Material-und Dünnschicht-Entwicklung. Und unsere Branche Erfahrung in der Materialphysik und Grundlagenforschung relevant sind intelligente Systeme und Hardware-Entwicklung."

Innerhalb der Chip-Industrie, sagte Armbrust SEMATECH wurde neu definiert Zusammenarbeit, indem sie mehrere neue Wege des Engagements:

  • Programm Mitgliedschaften, die Konsortial-R & D mit der frühen Produkt-Lieferanten "Entwicklung braucht auszurichten. Zwei Beispiele sind SEMATECH Resist Materials Development Center und die Mask Blank Development Center an der Hochschule für Nanoscale Science and Engineering der University at Albany.
  • Flexible Programmstrukturen, die Chip-Hersteller, Lieferanten, Fabless und Montage / Verpackung Unternehmen mit SEMATECH engagieren, um die Zusammenarbeit zu beschleunigen Entwicklung von kommerziellen Geräten und Standard-Materialien ermöglichen.
  • SEMATECH neu EUV Mask Infrastruktur-Konsortium ins Leben gerufen, mit anfänglichen Mitglieder verpflichtet, die Identifizierung und Schließung infrastrukturelle Probleme in der EUV-Maske Metrologie
  • Die Teilnahme in verschiedenen Industriesektoren Entwicklung von 3D-Interconnects mit Through-Silicon Vias-eine Branche Spiel-Wechsler, dass die Produktivität des Systems Wachstum ermöglicht neben der Skalierung und ermöglicht heterogenen Integration neuer System-on-Chip-Anwendungen
  • Umwelt, Sicherheit und Gesundheit (ESH) Initiativen zu fahren nachhaltige Produktion und reduzieren die Industrie des ökologischen Fußabdrucks durch Energieeffizienz und Ressourcenschonung, Supply-Chain-Ausrichtung, umweltfreundlicher Prozess der Entwicklung, und andere Maßnahmen. Die Internationale SEMATECH Manufacturing Initiative der ESH Technology Center wurde gegründet, um zu helfen Geräteherstellern und Lieferanten verfolgen diese Ziele
  • Kooperationen mit mehr als 80 Universitäten weltweit, um Projekte in kritischen Logik-und Speicher-Technologien zu verfolgen - darunter Bereiche wie fortschrittliche Materialien, moderne Geräte und Post-CMOS-Materialien und Strukturen. Jede Universität arbeitet mit SEMATECH gemeinsam zu entwickeln Prozesse, die zu kommerziellen Werkzeugen führen.

Armbrust Kommentare vorausgegangen fast 30 hochmoderne technische Präsentationen von Branchenexperten Lieferanten, FEP, und International SEMATECH Manufacturing Initiative (ISMI). Dazu gehörten:

  • Ein eingeladen Papier auf FEP Erfolg im Umgang mit Second Harmonic Generation (SHG), um die Auswirkungen unterschiedlicher Oberfläche reinigt und Passivierung auf Indium-Gallium-Arsenid (InGaAs) zu bewerten, wurde von Dr. Jimmy Price, Technical Staff Member geliefert. Price sagte die Fähigkeit, genau zu charakterisieren III-V Oberflächen und Grenzflächen mit SHGhighlights das Potenzial dieser Technik als in-line Messtechnik-System eignet sich für InGaAs-basierten Chip-Herstellung. "Wir haben jetzt eine nicht-invasive Methode, die Verfahren und die Vorrichtung Ingenieure verlassen sich auf die Qualität der III-V Oberflächen und Grenzflächen-Monitor", betonte er.
  • Ein Benchmarking-Studie von Michael Frisch, EHS Project Manager for International SEMATECH Manufacturing Initiative (ISMI), über Möglichkeiten für das Recycling und Rückgewinnung fab und Montage Test Abwässern. Frischs Studie zeigte, Recycling und die Aufarbeitung Chancen für die Rettung 5100000000 Gallonen pro Jahr (GPY) bei Mitgliedsunternehmen fab-Sites und 217 Millionen GPY bei der Montage Teststellen. Um dieses Potenzial nutzen, empfiehlt die Studie mit Schwerpunkt auf Recycling-Prozess Spülwasser und Rückgewinnung bulk Abwässer an Mitglied Fabs.
  • Eine Analyse von FEP-Projektleiter Dr. Casey Smith der Vorbereitung der Oberfläche und reinigt Herausforderungen für neue Technologien. Graphen, scheint eine vielversprechende Kanal-Material für Nicht-Silizium-HF-Anwendungen, obwohl Verunreinigungen ohne oxidierenden Chemikalien, um Schäden am Material zu vermeiden kontrolliert werden muss, bemerkt Smith. Für nicht-ebenen Technologien wie Multi-Gate-Feldeffekt-Transistoren (MuGFETs), sorgfältige Modifizierung der reinigt Reihenfolge ist erforderlich, um rückstandsfrei 3D Gatter bilden, besonders geeignet für enge Raster-Layouts.
  • Dr. Richard Hill, FEP Gerät Ingenieur, erläuterte die Chancen und Herausforderungen, wenn III-V-MOSFETs. Hill sagte: "Es ist immer schwieriger, weiterhin Silizium ohne Opfer in der Mobilität und Geschwindigkeit Skala. Sie können immer noch mit Silizium-Skala, aber es kommt zu einem Preis." Im Gegensatz dazu bieten III-V-Kanälen signifikante Performance-Vorteile, wie höhere Mobilität und eine größere Festplatte Strom, der weiterhin Skalierung und Performance-Verbesserungen ermöglichen. Hill qualifizierten seinen Optimismus jedoch durch die Erörterung der Herausforderungen, die Integration, bleiben die größte ist Dielektrikum-Grenzfläche Qualität.

Seit mehr als 10 Jahren hat SPCC führende Forscher aus Industrie und Wissenschaft gebracht, auf Herausforderungen im Wafer und Maske Reinigung und Vorbereitung der Oberfläche zu konzentrieren. SPCC ist Teil der SEMATECH Knowledge Series-eine Reihe von einzigartigen Möglichkeiten, die sich auf die Beschleunigung Lösungen für kritische Herausforderungen in der Nanoelektronik-Industrie konzentrieren.

Last Update: 4. October 2011 03:58

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