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Posted in | Nanoelectronics

삼성 전자는 32nm 저전력 HKMG 로직 공정 기술을 보내게

Published on June 11, 2010 at 2:19 AM

삼성 전자, (주), 고급 반도체 솔루션의 글로벌 리더는 오늘 자사의 파운드리 사업, 삼성 주조는 높은 - K 메탈 게이트 (HKMG) 기술로 32nm 저전력 (LP) 과정을 자격을 발표했다.

과정은 성공적으로 Giheung, 한국의 삼성 주조의 300 ㎜ 로직 제조 라인, S 라인에서 안정성 테스트를 완료하고, 지금은 고객의 설계 생산 준비가되었습니다. 32nm LP의 HKMG 로직 공정 기술 자격을 최초로, 삼성 주조는 차세대 휴대 가전의 미디어 집중, 에너지 효율 요구 사항을 충족하도록 설계된 칩 대량 생산을 시작할 태세입니다.

자사의 32nm LP의 HKMG 게이트 - 첫 번째 프로세스 노드를 두 번있는 경쟁, 첨단 프로세스 플랫폼을 제공하는 조정이, IBM 공동 개발 연합 (JDA)와 함께, 저전력 기술, 삼성 주조에서의 깊은 서브 마이크론 전문 지식을 활용 최소 제한적인 디자인 규칙을 통해 45nm 공정의 로직 밀도.

"이 결과는 완벽하게 통합된 리더십 파운드리 공정 기술을 제공하기위한 전략에 또 다른 중요한 이정표입니다 최첨단 저전력 SoC 설계에 대한 설계 솔루션,"스티븐 우, 부사장 겸 제너럴 매니저, 시스템 LSI, 삼성했다 전자. "몇 가지 주요 파트너와의 협력, 우리는 생산 환경에서 개발에서 구현 HKMG를받을 수있다. 고객은 이제 완벽 가장 진보된 32nm LP는 공정 기술, 설계 툴, IP를 HKMG하고 최첨단 모바일 실리콘 솔루션을위한 시장에 시간을 가속하기 위해 제조와 그들의 디자인 혁신을 통합할 수 있습니다. "

"SOC의 사용 high-k/metal 게이트 기술을 보여주는 가장 먼저 공장중인 삼성에 축하드립니다. 이것은 중요한 이정표가 경쟁력, 낮은 전력 "게이트 최초의"하이 - K 기술을 제공하는 IBM의 기술 개발 동맹에 의해 공동의 절정 대표 - 새로운 차세대 모바일 애플 리케이션에 이상적 "을 게리 패튼, IBM의 반도체에 대한 부사장은 말했다 연구 개발 센터.

자격 취득 과정의 일환으로, 삼성 주조는 동일한 주파수에서 45nm LP에서 구현된 SoC 설계에 비해 설계 30 % 동적 전력 감소 55 %의 누설 전력 감소를 보여주는 32nm LP 시스템 온칩 (SOC)을 생산 . 삼성 주조는 게이트 최초 HKMG 구현으로 인해 다음과 상당한 전력 감소 번호에 도달할 수있었습니다.

32nm LP 프로세스를 개발, 삼성 주조는 생태계 파트너들과 긴밀한 엔지니어링 제휴했습니다. 파트너 IP 성공적으로 통합이 SOC에 입증된 실리콘이 포함됩니다 :

  • ARM 1176 코어
  • 표준 셀, 메모리 컴파일러 및 I / OS의로 구성된 ARM 물리적 IP
  • Synopsys 'USB 2.0 OTG

삼성 주조 같은 32nm LP의 디자인 흐름에 중요한 진보를 통합할 수 Synopsys, 케이던스 디자인 시스템즈와 멘토를 포함한 EDA 파트너와 근무 :

  • 파워 게이팅, 멀티 임계값 전압, 다중 채널 길이와 적응 바디 바이어스 기술 등 고급 저전력 기술은 누설 전력을 줄이기 위해 사용되었습니다
  • 통계 정적 타이밍 분석 (SSTA)이 효과적으로 변화를 주소와 타이밍 마진을 줄이기 위해 사용되었다
  • 다양한 세포 및 칩 레벨의 DFM 기술은 제조를 향상시키는 데 사용되었다

삼성 전자의 파운드리 고객들은이 제품 입증된 디자인 인프라와 파운드리 사업에 고유의 지속적인 피드백 루프의 혜택을 누릴 수 있습니다.

첨단 로직 공정 기술에 광범위한 제조 전문 지식과 지속적인 개발, 삼성 주조는 주물 시장의 첨단 기술 솔루션 요구 사항을 해결에 초점을두고 있습니다. 삼성 주조의 32nm LP의 HKMG 공정 기술은 고객에게 수축 디자인 규칙과 28nm LP로 매끄러운 마이 그 레이션 경로를 제공하기 위해 개발되었습니다.

출처 : http://www.samsung.com/

Last Update: 5. October 2011 17:38

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