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I ricercatori internazionali discutere le strategie per 16 nm e oltre Process Technologies

Published on October 14, 2010 at 5:32 AM

I partecipanti al recente settimo annuale Simposio Internazionale sulle Tecnologie Avanzate Porta Pila discusso le strategie per implementare la logica e tecnologie avanzate di memoria per sub-16 nm nodi e oltre le tecnologie di processo.

Il Simposio, organizzato da SEMATECH, ha richiamato più di 100 ricercatori internazionali dell'industria e del mondo accademico che hanno condiviso le scoperte recenti e delineato nuove strategie gate stack per la generazione di tecnologia 16 nm e oltre.

"Siamo molto soddisfatti della partecipazione globale alla conferenza, e con il risultato - nell'esplorazione di soluzioni per stack funzionali per i futuri dispositivi," ha dichiarato Paul Kirsch, direttore SEMATECH dei processi di front end. "Il successo del Simposio può essere attribuito alla ampiezza e la profondità dei suoi partecipanti e dei loro risultati di ricerca. SEMATECH continuerà a lavorare in collaborazione con l'industria su questioni fondamentali per l'estensione logica CMOS e tecnologie di memoria. "

Le tecnologie che sono state high-k/metal gate stack di silicio (Si), Silicio Germanio (SiGe), III-V MOSFET ad alte prestazioni, in metallo / high-k / metal pile per la memoria Variazione di resistenza, memoria flash, memoria e cambiamento di fase .

Osservazioni principali includono:

  • Si stanno facendo progressi su Ge e III-V dispositivi alternativi materiale canale, anche se ci fosse il riconoscimento generale tra i partecipanti del Simposio che questo settore sarà necessario più impegno e più risorse per dimostrare soluzioni fabbricabili.
  • Presentatori vari affrontato le sfide dello stack funzionale per la logica e la memoria centrata su high-k metal gate di silicio, SiGe così come le preoccupazioni sulla III-V MOSFET ad alte prestazioni.
  • Consenso dei partecipanti è anche se ci sono molti ostacoli da superare, accatastamento verticale sembra la via più promettente per il ridimensionamento continuo.
  • Per compensare il rallentamento in scala e ottenere l'uniformità e affidabilità indirizzo, più recente, i materiali più innovativi e commutazione meccanismi di memorie non volatili devono essere ulteriormente analizzato.

Altri risultati comunicati al Simposio:

  • Presentatori Keynote, dalla tecnologia di Intel e Manufacturing Group e Macronix fornito una panoramica completa delle opzioni di scala transistor al di là del nodo 15 nm e le sfide di memorie non volatili tra cui floating gate per dispositivi planari e non planari.
  • High-k / metal gate problemi processo sono stati discussi da Sony, Toshiba, IBM e GLOBALFOUNDRIES, mettendo in evidenza i problemi con lo scaling dello stack.
  • Andrew Kummel della University of California, San Diego, ha discusso la teoria del funzionale densità (DFT) simulazioni suggerendo percorsi pratici per migliorare la qualità della high-k ossidi su entrambi i Ge e III-V interfacce.
  • Nella zona di sviluppo di memoria emergenti, il cambiamento di memoria resistenza è considerato uno dei candidati più promettenti per la prossima generazione della memoria. Vari materiali, dispositivi e architetture di selezione sono stati presentati. Architetture traversa sono stati discussi a futura memoria.
  • Il progresso impressionante Spin Torque Transfer (STTRAM) è stato discusso da Grandis, Everspin e l'Università della Virginia.
  • Diverse presentazioni esplorato nuovi materiali o alternativi e le architetture di là dispositivi CMOS per il 2020, compresi i dispositivi di spin elettronico, il grafene, e transistor nanowire. Prof. Kang Wang della University of California a Los Angeles riferito iniezione efficiente girare in Ge è stato realizzato utilizzando ossido di magnesio (MgO) ed è stato ottimizzato per girare il trasferimento della coppia.

Il Simposio Internazionale sulle Tecnologie Avanzate Porta Pila fa parte della serie Conoscenza SEMATECH, un insieme di pubblico, unico focalizzato incontri settore progettato per aumentare la conoscenza globale in settori chiave della semiconduttori R & S.

Fonte: http://www.sematech.org/

Last Update: 7. October 2011 02:43

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