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Posted in | Nanoregulations

X-FAB billigt Cadence Physical Verification System für ihre SoC Prozessknoten

Published on October 10, 2011 at 5:51 AM

Durch Cameron Chai

X-FAB, die einen Analog-und Mixed-Signal-Halbleiter-Anwendungen Gießerei-Gruppe hat die Cadence Physical Verification System für alle seine Verfahrenstechniken zugelassen.

Die Prüfung für das die Encounter und Virtuoso fließt von Cadence integriert wurde auch dem Design Rule Check (DRC) und Layout gegenüber schematische (LVS) die Überprüfung für alle Niveaus, wie Zelle, blockieren, Transistor und voller Chip / SOC. Die Prüfung kann auch mit allen standardisierten end-to-End-Digital-Analog-und Custom Flows in der Branche somit eine effizientere Methoden der Silizium-Realisierung. Integrieren

Der Hauptvorteil dieser Überprüfung ist, dass Kunden physisch zu überprüfen, ihre Prozesse im Rahmen der vom Design und Implementierung Umfeld damit die Produktivität erhöht. Teams in der Gestaltung beteiligt überprüfen können und abmelden DRC Validierung durch Identifizierung und Lösung von Fehlern in fließt. Dies im Gegenzug Ergebnisse in Zeitersparnis in langen Dauer der Produktion Schleifen und schneller Tape-Out. X-FAB Zustimmung ermöglicht dem Unternehmen, seine Leistung zu steigern und effizienter gerecht zu seiner Mixed-Signal-Kunden.

Laut John Murphy, der die Gruppe Direktor des Cadence Alliance Marketing-Abteilung, Cadence und X-FAB arbeitete eng effektiv erfüllen alle Anforderungen der Überprüfung und Einhaltung aller Parameter abmelden. Das Niveau der Zusammenarbeit ist für die Entwicklung des EDA360 Vision Programm, das auf die Erhöhung der Effizienz der Electronic Design Automation Industrie, indem sie die funktionale Verifikation Tools und die System Level Design ausgerichtet ist unerlässlich.

Quelle: http://www.cadence.com

Last Update: 10. October 2011 05:58

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