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GLOBALFOUNDRIES は Synopsys」 65、 40 の 28 の nm プロセスノードのための IC Validator 証明します

Published on December 12, 2011 at 1:44 AM

カメロンシェ著

Synopsys は物理的な確認の製品、 IC Validator が GLOBALFOUNDRIES の顧客へのレイアウト対設計図およびデザイン規則の小切手の runsets への即時のアクセス可能性の 65、 40 および 28 nm の物理的なサインオフのための GLOBALFOUNDRIES によって、証明されたと宣言しました。

IC Validator のギャラクシー実施のプラットホームのコンポーネントは、内部デザイン物理的な確認の実行の IC コンパイラーのための適したコンポーネントで、手動修理および遅段階問題の回避によって tapeout のサイクル時間を減らすことを場所およびルートエンジニアが可能にします。 証明は内部デザイン物理確認の特別な利点を使用するために GLOBALFOUNDRIES の 65、 40 そして 28 の nm の加工技術ノードで動作しているデザイナーを可能にします。

コマンド処理エンジンおよび拡張可能ハイブリッドデータを利用して、 IC Validator は必要とされた有望なプロセスノードのために困難な端および多角形ベースの規則をコードし、査定するための強いプラットホームを提供します。 それは退屈な低レベルデータの処理を自動化し、より高い抽象的概念のレベルでコードすることを割り当てます。 そのほぼ線形スケーラブルアーキテクチャはメモリわかっている、情報処理機能をもった、負荷バランシングおよびスケジューリングのの利用によって主流のハードウェアの使用を技術最適化します。 これらの機能はデザイン規則の開発そしてアプリケーションをアップデートし、洗練されたプロセスノードにかかわる共通の顧客に優秀なスケーラビリティおよび正確さを提供するために GLOBALFOUNDRIES を助けます。

内部デザイン物理的な確認は IC コンパイラーおよび場所およびルートエンジニアが訂正を自動化している間デザインの完了前に自動サイン・オフ品質の分析を遂行することを可能にする IC Validator の華麗な組合せです。 内部デザイン技術は速い ECO の確認のような高生産の機能を、タイミングわかっている金属の盛り土および自動 DRC 修理、場所の中のすべておよびルートセットアップ提供します。 内部デザイン物理的な確認は下流の分析ツールの高費用の繰り返しを除去し、物理的なサインオフに収束デザイン進歩を維持します。

ソース: http://www.synopsys.com

Last Update: 11. January 2012 06:01

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