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GLOBALFOUNDRIES は Synopsys を使用して 20 nm チップのためのケイ素の成功を」 IC コンパイラー AG 達成します

Published on December 16, 2011 at 1:08 AM

カメロンシェ著

Synopsys は GLOBALFOUNDRIES が IC コンパイラーの 20 nm バージョンである Synopsys を使用して最初少佐 20 nm チップのためのケイ素の (AG)成功を」 IC のコンパイラー高度の幾何学達成したと宣言しました。

IC コンパイラー AG は Synopsys の IC validator 内部デザイン Zroute の物理的な確認および技術でオーバーヘッドタイミングを減らし、サイズ停止する (DPT)よりよい二重模造の技術の解決を提供するために開発されます、完了を設計するために最も速い経路を作っている間。

二重コアプロセッサから成り立つこのチップからのテープは広範な DPT わかっている配置の解決および 20 nm 規則の進歩のための GLOBALFOUNDRIES と Synopsys 間のパートナーシップの重要な陸標です。 この大きいデザインのための選択によって、 IC コンパイラーは 20 nm デザインの科学技術の優勢を拡張しました。

問題の複雑さは管理容量、パフォーマンス、可変性と関連付け、力は他のプロセスノード転移と同じような 20 nm のプロセスノードのために次第に増加します。 ただし、 20 nm プロセスノードのための新しい挑戦は慣習的な前述の測定基準を達成したり、また二重交互になるパターンに装置領域かパフォーマンスに影響を与えないで分解するレイアウトの作成で器械を置き、経路を指定するために前例のない問題を作成する DPT です。

従って DPT への Synopsys の方法は場所およびルートのツールのパフォーマンスを維持し、最終的段階の驚きを除去しま、最終的な tapeout の速度を計ります。 Zroute の経路指定の技術および DPT が高められて配置エンジンは、 IC コンパイラー効率的に IC Validator 内部デザイン物理的な確認の技術を利用する残りの DPT の違反のために査定され、調整することができる DPT わかっているレイアウトを作成しました。 GLOBALFOUNDRIES は Synopsys を密接に 20 nm 技術の進水の間のこの流れを同時に提供するために使用しています。

ソース: http://www.synopsys.com/

Last Update: 11. January 2012 04:24

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