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Posted in | Nanobusiness

TSMC は 20 nm および CoWoS をサポートする参照の流れを提供します

Published on October 10, 2012 at 5:40 AM

TSMC は開いた革新 Platform® 内の 20nm および CoWoS™デザインサポートの準備が 20nm および CoWoS™ (OIP) (基板のウエファーのチップ) の技術をサポートする 2 つの鋳物場最初参照の流れの配達によって示されることを今日発表しました。

TSMC の 20nm の参照の流れは証明されたデザイン流れを使用して (DPT)二重模造の技術デザインを可能にします。 導く EDA のベンダーのツールは製造のための DPT のわかっている場所およびルート、タイミング、物理的な確認およびデザイン組み込むことによって TSMC 20nm の加工技術を使用するために修飾されます (DFM)。 複数のダイスの統合が高い帯域幅をサポートすることを可能にする新しいケイ素認可された CoWoS™の参照の流れは 3D IC デザインのための市場タイムに低い電力速く達成できます。 CoWoS™の流れはまたそれらのの EDA のベンダーを導くことからの主流のツール存在を使用することを許可によってデザイナーに寄与します。

「これらの参照の流れデザイナーに TSMC の進められた 20nm へのアクセスを与え、 CoWoS の技術」、は R & D の TSMC の副大統領、 Cliff Hou 先生を言いました。 「渡すことは私達の顧客に可能 TSMC および OIP デザイン生態系パートナーのための主な目的が」。である早いケイ素および製造技術を同様におよび完全に進めました

20nm 参照の流れ

TSMC の 20nm の参照の流れは DPT のわかっている機能の 20nm デザインがデザイン複雑さを減らし、必須の正確さを提供することを可能にします。 DPT の enablement は前カラリング機能、新しい RC の抽出の方法、 DPT のサイン・オフ、物理的な確認および DFM を含んでいます。 さらに、 TSMC および生態系パートナーは DPT の承諾のための 20nm 20nm プロセス採用を加速するように IP を設計します。

CoWoS™の参照の流れ

CoWoS™の参照の流れは 3D IC の複数のダイスの統合を可能にします。 新しい CoWoS™の参照の流れは既存の方法の最小の変更との 3D IC へのスムーズな移行を可能にします。 それは配置の管理および隆起、パッド、相互接続および C4 隆起の経路指定を含んでいます; 革新的なコンボ隆起の構造; 高速の正確な抽出そして信号の保全性の分析はダイスの間で相互接続します; システムに包むべきチップからの熱分析; そしてダイスレベルおよびスタックレベルのテストのための統合された 3D テスト方法。

参照の流れおよび RF の参照デザインキットをカスタム設計して下さい

カスタム設計の参照の流れは 20nm 習慣のレイアウトの DPT を可能にします。 それはシミュレーターを電圧依存した DRC の規則の確認のための直接接続を含む 20nm プロセス条件に解決に、および HKMG の技術の統合された LDE の解決および処理与えます。 RF の参照デザインキットは新しい高周波設計のガイドラインを提供します。 これらは 60GHz RF モデルサポート、実施の流れおよび統合された (EM)受動装置サポート前部に 60GHz の例によって顧客デザイン機能を可能にする高性能の電磁石の性格描写から (IPD)成っています。

ソース: http://www.tsmc.com

Last Update: 10. October 2012 06:24

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