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3D-TSV Conta Wafers por mais de 6% do total da Indústria de Semicondutores em 2015

Published on July 30, 2008 at 10:57 AM

Investigação e Mercados anunciou a adição do "3-D TSV Interconexões - Equipamento + Materiais Relatório de 2008" denunciar a sua oferta.

A Próxima Revolução para Semiconductor Embalagem e Assembléia de Circuito das Indústrias

A indústria de manufatura de semicondutores enfrenta hoje mais do que nunca o desafio de explorar o chamado "Mais-que-Moore" rota de integração 3-D a fim de prosseguir o escalonamento continuou agressivo da Lei de Moore histórico. Toda Semiconductor cadeia de suprimentos da indústria está sendo em causa: a partir de IDMs para fundições Fabless e CMOS, desde OSATs para Substrato e jogadores Assembléia Circuit também. Nós acreditamos que a integração com 3D TSVs poderia acelerar ainda mais a consolidação atual acontecendo no wafer fabs CMOS ea mudança para um modelo de fundição fabless. Como toda a cadeia da indústria está sendo em causa, todos os jogadores estão no posicionamento momento na tecnologia e na avaliação sobre quais 3-D plataformas de tecnologia precisa ser investido e desenvolvido para seu próprio negócio.

Vezes são brilhantes para empacotadores de todo o mundo. Uma infra-estrutura totalmente nova precisa ser desenvolvida no "Mid-end" da cadeia de abastecimento indústria de semicondutores. Novas Tecnologias, Equipamentos e Materiais Avançados vinda tanto do front-end e back-end mundos estão sendo desenvolvidos e dará origem a uma nova restauração das embalagens de semicondutores e indústrias de montagem de circuitos. As nossas previsões mais recentes do mercado mostram que o 3D-TSV wafers será enviado em milhões e têm o potencial de impacto em até 25% do negócio de memória em 2015. Se excluirmos as memórias, nossa análise mostra que o 3D-TSV wafers poderia ser responsável por mais de 6% da indústria de semicondutores total em 2015.

Este novo estudo visa dar uma melhor compreensão sobre a linha do tempo certo para o sucesso na adoção do Silicon Através de Via (3-D de interconexão TSV), tecnologia em toda a vasta gama das suas dirigir-end. Os dois relatórios ainda quantificar o impacto potencial de tecnologias 3-D no mercado de fabricação de semicondutores (a nível de dispositivo / equipamento / material) e avaliar a forma como a cadeia de suprimentos da indústria tende a evoluir no 2009-2015 prazos.

Exemplos de grande descoberta deste novo estudo de pesquisa de mercado são:

- Motivações para ir ao 3-D são bastante claras e não mudaram muito desde que a tecnologia tem sido introduzida com sucesso na produção de MEMS e sensores de imagem CMOS já: é toda sobre a realização formato menor com densidades pacote maior, para atender a largura de banda, RF, melhorias de desempenho e consumo de energia para manter com a redução de custos ainda mais. Custo é definitivamente definido para ser a mais forte motivação para desenvolver tecnologias 3D no longo prazo. Além disso, nós vemos vários jogadores sendo impulsionada por motivações confiabilidade: os sistemas de maior confiabilidade pode ser fabricado através da integração vertical de várias camadas usando 3-D TSVs em vez de fios de títulos ou Flip-chip de interconexões, usando óptica 3D empilhadas nível wafer em vez de injeção de plástico moldado módulos lente. Do ponto de muitos dos pontos de vista, 3-D parece ser um forte propício para a introdução bem sucedida de cada vez mais integrada novos sistemas em ambientes de restrição dura e espaço de aplicativo, como na indústria automotiva, Bio, Telecom e mercados de consumo, entre outros.

- Roteiro por aplicação WL-CSP sensores de imagem CMOS estão a ponto de deixar a sua vantagem conexões tradicionais de configuração para ir à "real" 3D-TSV arquiteturas tão logo este ano. Vias serão parcial ou totalmente preenchido, dependendo via preenchimento abordagem a ser desenvolvido (de cobre para o enchimento parcial, Silicon-Poly ou tungstênio para vias completamente cheio). Além disso, vemos claramente o número de I / Os expandindo para várias centenas de interconexões por chip, com uma tendência a empilhar os chips DSP sob o chip sensor de imagem em si. MEMS também tirar partido 3-D, a fim de combinar a MEMS com sua ASIC enquanto PIS Wireless vai combinar camadas heterogêneas todos juntos (construído em nós litografia diferentes, substratos diferentes materiais, tais como Si, GaAs, SiGe ...). O mercado para o 3-D empilhados memórias é iminente: é impulsionado principalmente por memórias RAM com base primeiro, entretanto mais e mais memória Flash está definido para ser combinado no futuro dentro de MCP, PoP / SiP pacotes, celular de cartão de slots e SSDs . A questão agora é mais sobre quem irá suceder a desenvolver primeiro o processo de menor custo e irá assumir o risco do investimento inicial grande infra-estrutura necessária. Indo mais longe, Logic 3D baseado em SOCs-se para definir a decolagem no prazo de 2-3 anos para diferentes aplicações. Na verdade, este tipo de "verdade" do 3D-IC integração será alcançada através da segregação progressiva de várias camadas: Particionamento de memórias 3D embutido, RF, analógico e I / Os camadas do chip de base lógica será alcançado no mais rentável forma, reduzindo áreas de tamanho total chip. Estamos hoje confiantes que o 3D-ICs em breve mostrar mais rentável em comparação com as abordagens tradicionais SOC uma vez que irá permitir a partição de uma forma rentável as diferentes funções hoje todas integradas na grande área SOC morre. Além do custo, esses chips 3-D, adicionalmente, os benefícios de melhorias de desempenho como o comprimento de interconexão será encurtado e repetidores serão removidos. Isto permitirá que a indústria CMOS para "virtualmente" vão além do nó de 32 nm em termos de custo de chip, tamanho e desempenho.

- Nós acreditamos que diferentes plataformas de 3-D tecnologia precisa ser desenvolvida como eles vão servir as necessidades de aplicação diferentes e correspondem a diferentes atores na cadeia de abastecimento:

- - 3-D plataforma de encapsulamento WLP é hoje já em produção em sensores de imagem CMOS com via através da parte de trás do wafer. Ele se expandirá para módulos amplificador de energia também. Pacote de MEMS são mais complexas como a maioria destas aplicações vai precisar de uma cavidade full-hermética através do uso de getters e tecnologias de ligação mais especializados.

- - 3-D plataforma Stack TSV está sendo desenvolvido principalmente para as memórias empilhadas e lógica 3D-SOCs mais tarde. Se via-última será responsável por uma grande parcela do mercado, vemos uma clara tendência para via-primeiro configurações e tamanho menor vias aproximando 1-500-2000 com diâmetros 5um interliga por chip normalmente.

- - 3-D plataforma Módulo interposer já está em produção muito pequena para aplicações de MEMS diversas a fim de combinar os chips ASIC e MEMS juntos em uma abordagem WLP verdadeiro (interposer O silício age aqui na substituição direta do substrato orgânico). Esta plataforma tecnológica é provável que expandir-se rapidamente em espaços muitas aplicações SIP. Na maioria dos casos, o silício 3D interposer é usado como um "companheiro chip" do módulo para o sistema 3D integrados. Benefícios de tal interposers 3-D de silício incluem excelente propriedades intrínsecas térmica (CTE) do pacote de silício / substrato / board eo potencial de escala para interligar campos ilimitado. Além disso, aproveitar a possibilidade de ser mais e mais "engenharia" entre tempo com a capacidade de integrar dispositivos passivos, para formar cavidades ou mesmo para construir micro-canais para refrigeração eficiente módulos de gerenciamento térmico. Mais genericamente, 3-D interposers silício deve ser de baixo custo e podem ser manipulados ou fabricados por empresas subcontratadas IDM, se a cadeia de valor pode ser assegurada a confidencialidade. Nós vemos tot

Last Update: 4. October 2011 07:55

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