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를 통하여 실리콘 Vias의 대폭적인 채용을 가능하게 하는 적용되는 물자 지도 중요한 노력

Published on December 1, 2008 at 6:19 PM

를 통하여 실리콘 vias의 대폭적인 채용, 수직으로 겹쳐 쌓이기 직접 회로 (IC)를 위한 급속하 나오기 접근을 (TSVs) 좁은 지역에 있는 칩 성과 그리고 기능을 밀어주는 가능하게 하는 중요한 노력을 지도하고 있다는 것을 Applied Materials, Inc.는 오늘 알렸습니다. TSVs는 더 단단, 더 작은 전자공학을 위한 충분한 소비자 요구에 중대하, DDR4 드램 기억 장치 미래 커뮤니케이션 이동할 수 있는 인터넷 칩과 같은 응용을 가능하게 하. TSVs 실행에 가장 큰 방책이 요하기 때문에, 내부에 그리고 그밖 장비 공급자로 통합의, 고성능 에 웨이퍼 가공 교류를 비용을 낮추기 위하여 개발하기 위하여 작동하고, 리스크를 감소시키고 그리고 고객을 위한 시장철을 가속합니다 적용하는.

3차원 (3번째) IC 통합은 반드시 기술 마디를 오르기 발자국 없이 더 작은 것에 있는 고밀도, 낮은 전력 소비 장치를 전달하는 반도체 디자이너를 위한 새로운 쪽 입니다. 전통적인 웨이퍼 가공 및 포장 단계를 변경해서, 유사하거나 다양한 제 2 장치의 다중 층은 겹쳐 쌓이고 TSVs를 사용하여 상호 연락해 이렇게 단 하나로 작용해 장치 따라서 1개의 칩에 다중 기능 결합과 관련된 비용, 공간 및 성과 문제점을 피하.

TSV 실시에 몇몇 접근이 있고, 적용하는 생산 증명한 300mm 시스템 및 프로세스가 가면, 식각, 필름 공술서 및 CMP* 기술을 포함하여 TSV 제조 단계의 대다수를 위해, 요구된 있습니다. 예를 들면, 동시에 알려진 적용되는 Centura® Silvia™ 식각 시스템 고성능, 값이 싼 TSV 응용을 가능하게 하기 위하여 특히 디자인되었습니다. 적용된 주류 채용을 가속하는 것은 Semitool Inc.와 같은 그밖 장비 공급자로 전반적인 비용을 낮추고 있는 동안과 웨이퍼 bonders, 완전히 상호 속국을 성격을 나타내기 위하여 작동하고 있습니다.

TSV 가능하게 된 제품의 가치는 차례차례로 제조의 증가한 비용을 오프셋할 그들의 강화된 성과에 현저하게 기지를 두어 증가할 것으로 예상됩니다. 장비 공급자의 EMC-3D 협회는 웨이퍼 당 $190살이기 위하여 이 비용 표적을 추정합니다; 적용되는 목표는 웨이퍼 당 $150 이하 이 비용을로 삭감하기 위한 것입니다.

"TSV 기술은 칩 설계를 혁명을 일으키고 더 정교한 통합 기억 장치/논리 응용으로 확장하는 중대한 가능성으로 가지고있ㅂ니다. 그밖 장비 공급자와 가진 우리의 협력은 기업을 위해 유리하 우리의 고객의 문제를 해결할 수 있는 사업의 혁신적인 방법," 말했습니다 적용되는 실리콘 시스템 단의 Hans 황새, 단 부사장 및 CTO를입니다. "우리의 Maydan 기술 센터에 완전한 가공 교류를 유효하게 하는 기능은 우리가 어떻게로 비용을 낮추고 TSV 프로세스지 채택에 있는 고객 리스크를 감소해 좋은지 저희에게 유일한 Windows를 줍니다. 기술과 키 공급자 관계를 제공해서, 우리는 주류 제조를 위한 TSVs의 채용을 가속하는 것을 도와서 좋습니다."

Last Update: 14. January 2012 17:16

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