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ARM y la cadencia Colaborar para permitir a la nueva generación de IP física para el proceso de 45 nm SOI de IBM

Published on July 27, 2009 at 8:43 AM

Cadence Design Systems, Inc. (NASDAQ: CDN) , el líder mundial en innovación de diseño electrónico, ha anunciado hoy que han validado una nueva generación de bibliotecas ASIC de ARM con el Cadence ® Encuentro Digital System ® Implementación objetivo de 45 nanómetros de IBM en silicio sobre aislante (SOI) el proceso de fabricación. El desarrollo marca un nuevo hito en la colaboración de varios años que permite la utilización eficiente de bajo consumo de energía de IBM de alto rendimiento y la tecnología SOI de próxima generación de diseños.

"Nuestra colaboración con la cadencia en la validación inicial de sus herramientas garantizar la preparación del diseño para los clientes de la tecnología de 45nm de IBM SOI. Colectivamente, ARM, cadencia e IBM ofrecen una plataforma de diseño fiable donde la velocidad, funcionalidad y bajo consumo de energía son necesarias", dijo Tom Lantzsch, vicepresidente de la división física IP, ARM. "Estos nuevos de silicio de 45 nm validado bibliotecas SOI permitirá la creación de SOC eficiente de la energía, reduciendo el tiempo y coste de desarrollo."

Las bibliotecas de 45 nm SOI ARM se han desarrollado con la cadencia Virtuoso ® plataforma de diseño personalizado 6.1 y validado en múltiples diseños en el Sistema de Ejecución Encuentro Digital cadencia, un completo RTL a GDSII entorno de diseño que ofrece el formato de Si2 Poder Común (CPF) de baja diseño de energía, nativo visto bueno en el lazo para la extracción de interconexión, el tiempo, el poder y la integridad de señal, además completamente integrado de diseño para la fabricación de tecnología de cadencia (DFM). Toda la cadencia de extremo a extremo el diseño, implementación y solución de verificación se ha demostrado que apoyar plenamente el proceso de fabricación SOI.

"La colaboración entre la cadencia, ARM e IBM es de vital importancia para los diseñadores de objetivos de nuestra tecnología SOI", dijo Richard Busch, director de IBM Productos ASIC. "Es imperativo que estas bibliotecas se han diseñado, implementado y verificado en estrecha relación con nuestro proceso de SOI para que los diseñadores pueden obtener todos los beneficios de un mayor rendimiento y menor consumo de energía en comparación con las tecnologías CMOS a granel".

"Estamos muy contentos de desempeñar un papel vital en esta colaboración para ofrecer avanzados SOI soluciones listas para la comunidad del diseño en un momento en la posibilidad de igualar el rendimiento y los requisitos de energía son una preocupación cada vez mayor", dijo el Dr. Chi-Ping Hsu, vicepresidente senior de investigación y desarrollo para el grupo de aplicación a la cadencia. "Como líder del sector en el impulso de soluciones avanzadas de bajo consumo de energía, la colaboración con otros líderes en el Consorcio SOI permite un rápido despliegue de la integral de alto rendimiento y tecnologías de eficiencia energética de procesos integrados con las metodologías de diseño de la industria estándar."

Last Update: 9. October 2011 11:20

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