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Posted in | Nanoelectronics

Capacidades integradas encontro do DFM proporciona um fluxo End-to-end completa para STARCAD-CEL Fluxo Ref V3.0

Published on July 8, 2009 at 9:03 PM

Cadence Design Systems, Inc. (NASDAQ: CDNS) , líder em inovação de design global, anunciou hoje a japonesa de semicondutores consórcio de investigação STARC (Semiconductor Tecnologia Academic Research Center), integrou o Cadence ® Encounter ® Digital Sistema de Execução, com seus integrada DFM tecnologias, como o seu fluxo de DFM 45 projetos visando nanômetros e abaixo. A suite integra DFM abrangente Analyzer Litho Cadence Física (LPA), Analyzer Litho Cadence Elétrica (LEA), e Prognósticos CMP Cadence em cockpit do designer. Usando o Cadence habilitado STARCAD-CEL Fluxo Ref V3.0, designers ganham acesso imediato ao processo de fabricação com precisão de informações no início do fluxo de projeto físico, onde os engenheiros podem alavancar a integração perfeita na implementação digital para identificar, analisar e corrigir o rendimento de limitação hotspots para os seus avançados-node designs. Além disso, com Litho Analyzer elétrica, os designers podem analisar o impacto no desempenho do transistor lito e fazer o projeto de trade-offs necessários para satisfazer os seus critérios de design.

"O novo STARCAD-CEL Fluxo de Referência V3.0 endereços crítica design para fabricação de preocupações para 65nm, 45 nanômetros e tecnologias de processo avançado", disse Nobuyuki Nishiguchi, Vice Presidente e Gerente Geral, Departamento de Desenvolvimento de 1 a STARC. "Cadence Encontro Digital Sistema de Execução com Litho Analyzer Física desde a detecção hotspot muito precisos lito e correção e cem por cento de correção dos defeitos catastróficos ou rendimento limitante em nosso projeto de teste, enquanto também proporciona um tempo de resposta mais rápido."

O Analisador de Litho Cadence Física aproveita a força da CPU multi-capacidades de processamento paralelo, juntamente com a proprietária, algoritmos fundamentais oferecendo maior escalabilidade e desempenho linear do tempo de resposta mais rápido conforme relatado por STARC. Junto com os avanços na modelagem múltipla tecnologia de processo e integração com a Cadence Virtuoso ® IC personalizado e Encontro Plataformas Implementação Digital, Cadence oferece uma completa "corrigir-by-design" solução de implementação digital para celular / bloco para full-chip.

"A indústria de semicondutores e tecnologias DFM ecossistema reconhece como essenciais para a Cadence metodologias de design avançado hoje", disse o Dr. Chi-Ping Hsu, vice-presidente sênior de pesquisa e desenvolvimento implementação digital da Cadence. "É a diferença entre a identificação de problemas DFM potencial durante a fase de projeto e corrigi-los ali mesmo no sistema, versus descobrir defeitos rendimento limitante durante o processo de fabricação, quando é tarde demais. Estamos orgulhosos de estar trabalhando em estreita colaboração com STARC para provar a vantagens da nossa tecnologia DFM e solução de implementação digital para seus 45 nanômetros fluxo de projeto de referência. "

Empresas de semicondutores em todo o mundo estão agora exigindo análise DFM durante a fase de design, ea maioria das 20 maiores empresas de semicondutores já adoptaram soluções Cadence do DFM para atender a sua precisão, metas de desempenho e rendimento.

Last Update: 9. October 2011 23:16

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