대륙간 탄도탄 플래트홈은 첫번째 시간 맞은, 예상할 수 있는 혼합 신호 실리콘을 투발하는 것을 디자인했습니다

Published on July 22, 2009 at 10:39 AM

연괴 (r) 디자인 자동화 Inc (NASDAQ: 연괴의 대륙간 탄도탄 (tm) 혼합 신호 플래트홈이 TSMC 65 nm 공동이용이 가능한 공정 설계 장비의 정보 처리 상호 운용과 정확도 필수품을 지원하기 위하여 TSMC에 의하여 자격을 줬다는 것을 용암), 오늘 알려지는 칩 설계 소프트웨어의 공급자 (iPDK). iPDK는 다중 소유 PDKs 및 설계 데이타베이스를 개발하고 이용하는 필요를 삭제해, 설계 자료의 가득 차있는 재사용을 가능하게 하. 대륙간 탄도탄의 진행한 기능 및 정확한 iPDK에서 제공된 혼합 신호 실리콘에 고속 경로를 프로세스 모델 및 가공 데이터의 조합은 디자이너에게 제공합니다.

TSMC 열리는 혁신 플래트홈 (tm)를 통해서 발전해, OpenAccess 데이타베이스 및 자료 모형에 iPDK가 근거를 둡니다. iPDK는 개방 기준 언어, Tcl 그리고 Python를, 대본을 쓰고 프로그램을 위한 특색짓고, 기호, parameterized 배치 세포, 되부름 및 기술 파일의 완전한 통일한 전망을 포함합니다. 현대 iPDK와 유연한 아키텍쳐는 쉽게 특정 주문화, 미래 특징 연장 및 진행하고 분화한 발달을 수용합니다.

"IPDK 전체 디자인 생태계를 통해 정보 처리 상호 운용을 허용합니다, 우리의 고객의 혼합 신호의 디자인 재사용 그리고 이식 가능성을 간단하게 해서 디자인합니다,"는 ST Juang를 TSMC에 디자인 기반 매매의 고위 디렉터 말했습니다. "연괴는 작년부터 TSMC로 작동하고 그리고 iPDK의 정보 처리 상호 운용 그리고 질을 유효하게 하기에 있는 중요한 역할을 했습니다. 우리는 대륙간 탄도탄이 iPDK 품질 규격의 고도 TSMC를." 충족시킨다는 것을 증명하는 만족됩니다

"아날로그와 혼합 신호 디자인에 있는 혁신 예상할 수 있는 디자인 재사용의 부족에 의해 질식되고 향하는 교류,"는 Anirudh Devgan를, 연괴의 총관리인 주문 설계합니다 사업 단체를 말했습니다. "함께 작동해서 유효하게 하는 것은 대륙간 탄도탄, 연괴 및 TSMC를 가진 iPDK를 혁신에 디자이너가 대륙간 탄도탄과 같은 최고 에서 종류 공구를 채택하도록 가장 중요한 방벽의 한을 제거하고 그것을 매우 쉽게 했습니다. iPDK와 함께 사용될 때, 대륙간 탄도탄은 정확도 성과의 어떤 손실도 없는 그들의 전통적인 디자인 교류를 가속하는 가능하게 할 것입니다 디자이너를."

대륙간 탄도탄: 고속 경로 혼합 신호 실리콘

대륙간 탄도탄이 아날로그 회로 설계를 가진 디지털 표준 세포 디자인의 통합을 가능하게 하는 첫번째 확실하게 통일하곤, 열리는 플래트홈입니다. 대륙간 탄도탄은 고유하게 iPDK와 같은 OpenAccess 그리고 나오는 업계 표준을 지원합니다. 가득 차있 관례를 위해 요구된 가득 차있는 기능 세트를 가진 대륙간 탄도탄 플래트홈 제안 개략도와 배치 편집자는 디자인합니다.

대륙간 탄도탄 ADX, 연괴의 대륙간 탄도탄 혼합 신호 디자인 플래트홈, 아날로그/혼합 신호 디자인, 최적화를 해결하고 도전을 향하기에 초점의 불가결한 부분. 그것의 새로운, 모형 기지를 둔 접근은 전통적인 시뮬레이션 기지를 둔 기술로 요구된 일부 시간에서 회로 최적화 그리고 향하기 허용합니다. 대륙간 탄도탄 ADX는 아날로그 디자인에서 어림짐작을, 그러나 환원력 및 지역 50% 까지 취합니다. ADX 기술은 제품 그룹을 극단적인 성과를 위한 디자인 봉투를 밀고, 다중 프로세스, 전압 및 온도 (PVT) 구석 케이스를 위한 디자인을 중심에 두고, 힘과 불안감을 감소시키는 가능하게 합니다.

대륙간 탄도탄 배치 편집자는 고속 접근을 제공하고 시간과 디지털 두 및 수송한 데이터를 전망하고 변경하는 기능을 편집합니다. 단단, 모양 기지를 둔 아날로그 알고 있는 대패로 결합해, 대륙간 탄도탄 배치 편집자는 디자이너에게 특정 회로 요구에 응하기 위하여 가득 차있는 관례에서 가득 차있는 자동화에 구역 수색하는 옵션을 줍니다. 이 특징은 대륙간 탄도탄에게 가득 차있 관례를 위한 이상적인 환경을 디자인하 뿐 아니라 칩 수준 계획, 집합 및 끝마무리.

Last Update: 14. January 2012 02:24

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