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향상된 모델링 고급 노드 설계를 가속 디지털 구현 시스템 만남 가능

Published on July 29, 2009 at 9:06 AM

케이던스 디자인 시스템즈 (NASDAQ : CDNS) , 글로벌 전자 설계 혁신의 리더는 오늘 IBM의 제조, 32 나노미터 (나노미터) 공통 플랫폼 하이 - K 메탈 게이트 (HKMG) 기술에 대한 첫 번째 실리콘 결과를 발표했다. 케이던스 ® 및 IBM, 차터드 반도체 제조와 삼성 전자로 구성된 공통 플랫폼 얼라이언스는, 고급 노드 설계에서 체계적이고 임의의 다양성을 해결하기 위해 협력. 실리콘 결과와 디자이너를위한 중요한 이정표를 대표하는 엄격한 설계 - 제조 (DFM) 요구 사항, 그리고 만남 사용할 수 있습니다 ® 디지털 구현 (EDI) 상당한 전력 절감, 수율 향상 및 시간 - 투 - 마켓 이점을 제공하는 시스템.

32nm 실리콘 결과는 레이아웃 규칙, 디자인 규칙 확인 및 장치 상호 연결 모델에 관련하여 HKMG 프로세스를 모델링 세트 풍부하고 광대한 데이터를 제공합니다. 또한, 그들은 이내 죽음과 다이 - 다이에 변동뿐만 아니라, 리소그래피, 열, 스트레스, 근접 효과 및 구리 증착을 포함한 생산 효과, 임의의, 체계를 포함하여 장치와 상호 변화에 관한 중요한 정보를 캡처합니다. 실제 설계 과정 중에이 제조 인텔리 전스를 사용하여 케이던스 만남 디지털 구현 시스템은 초기 및 실리콘 정확한 DFM과 다양성 모델링, 특성화 및 완벽한 엔드 - 투 - 엔드 플로우를 제공하기 위해 최적화를 설정할 수 있습니다.

"우리는 정확하게 장치와 상호 다양성을 모델링하기위한 목적으로 초기 하드웨어를 구축하기 위해 케이던스과의 긴밀한 협력을했습니다,"마크 아일랜드, 부사장, 공통 플랫폼 제휴를 대신하여 IBM 반도체 플랫폼 고 말했다. "일찍 일어나는 학습은 만남 도구 제품군에 실리콘 정확한 모델과 DFM 지원을 통합하기 위해 케이던스 수 있도록합니다. 이것은 상당히 향상된 성능과 함께 차세대 장치를 제공하는 디자이너를위한 32/28nm 높은 - K 메탈 게이트 기술의 채택을 가속하는 데 도움이 그리고 배터리 수명. "

EDI 시스템은 물리적인 구현 흐름에 걸쳐 적용할 수있는 DFM 및 통계 기술의 전체 제품군이 포함되어 있습니다. 제조 및 수율은 모든 측면은 최종 tapeout 전에 holistically 해결되도록하는 타이밍, 신호 무결성, 전력, 지역 최적화와 동시에 해결하실 수 있습니다. 모델링 및 초기 설계 단계에서 변화에 대한 최적화함으로써, 설계자는 전체 처리 시간을 줄이고 칩이 의도한대로 동작한다는 자신감을 향상시킵니다. 이러한 기술이 32/28nm 기술에 확인되면, 볼륨에 더 시간이 높은 고품질의 실리콘의 결과, 설계 예측을 증가 가능성이 있습니다.

"이 발표, 케이던스는 혁신적인 제조 파트너와 업계 리더십을 보여주는 '치 - 핑 수의, 케이던스의 구현 제품 그룹에 대한 연구 및 개발 담당 수석 부사장은 말했다. "32/28nm에 케이던스와 공통 플랫폼 제휴 협력은 아직 우리의 장기적인 투자와 선진 기술 개발에 노력하는 또 다른 증언이다. 케이던스 고객이 먼저 그들의 첨단 제품을 유치하는 데 도움이 제품과 기술 리더십은 빨라 속도를 계속 시장. "

Last Update: 4. October 2011 16:09

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