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Posted in | Nanoelectronics

STMicroelectronics presenta el nuevo microprocesador de 55 nm basado en la tecnología HCMOS

Published on July 30, 2010 at 2:16 AM

STMicroelectronics (NYSE: STM), líder mundial en el sistema en un chip de tecnología, ha presentado hoy en la industria el primer microprocesador incorporado que dos parejas ARM Cortex-A9 núcleos con una (tasa de tercera generación doble de datos) de interfaz de memoria DDR3.

Fabricado en baja potencia de ST HCMOS 55nm (CMOS de alta velocidad) la tecnología de proceso, el SPEAr1310 ofrece una potencia de computación de alto y capacidad de personalización para múltiples aplicaciones integradas, junto con el alto nivel de competitividad de costos que ofrece el sistema-on-chip.

El nuevo microprocesador combina la potencia sin igual de baja y las capacidades de multi-procesamiento de la ARM Cortex-A9 núcleo del procesador con la innovadora Red-on-Chip (NOC) de tecnología. El ARM Cortex-A9 de doble procesadores soportan las dos operaciones totalmente simétrica y asimétrica, a velocidades de 600MHz/core (industrial peores condiciones) para 3000 DMIPS equivalente. NOC es una arquitectura de comunicaciones flexible que permite múltiples perfiles de tráfico diferentes al tiempo que maximiza el rendimiento de datos en la mayoría de los resultados-y de bajo consumo forma.

"SPEAr1310 es el primer dispositivo en el recientemente anunciado SPEAr1300 familia y otros seguirán en breve", dijo Loris Valenti, Gerente General de Informática de STMicroelectronics División de Sistemas. "Con su arquitectura innovadora y potente conjunto de características, SPEAr1310 está en la vanguardia del mercado de procesadores integrados, y permite una mezcla sin precedentes de la competitividad de costos, rendimiento y flexibilidad."

Equipado con un controlador de memoria integrado DDR2/DDR3 y un completo conjunto de periféricos de conectividad, incluyendo USB, SATA y PCIe (con PHY integrados), además de un Giga Ethernet MAC, el microprocesador ST SPEAr1310 objetivos de alto rendimiento con control incorporado aplicaciones a través de segmentos del mercado de la comunicación y periféricos para la automatización industrial.

Coherencia de caché de memoria con aceleradores de hardware y los bloques de E / S aumenta el rendimiento y simplifica el desarrollo de software. El Acelerador de Coherencia Port (ACP), junto con NoC capacidades de enrutamiento del dispositivo, las direcciones de los últimos requisitos de solicitud de aceleración del hardware y el rendimiento de E / S. ECC (Error Correction Coding) la protección contra errores blandos y duros en ambos DRAM y memoria caché L2 mejora drásticamente el tiempo medio entre fallos para una mayor fiabilidad.

Fuente: http://www.st.com/

Last Update: 29. November 2011 20:47

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