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新的28納米簽收就緒流量GLOBALFOUNDRIES公司為芯片設計師

Published on January 13, 2011 at 4:28 AM

GLOBALFOUNDRIES公司今天宣布推出業界首個 28nm的矽驗證簽收準備數字化設計流程,以幫助芯片設計師提供的功率敏感的移動和消費電子設備的下一代。

EDA / IP生態系統領導人的合作和發展的基礎上GLOBALFOUNDRIES“的28nm超低功率(SLP)與門第一高- k金屬門(HKMG)技術,流量精確調整,以幫助克服設計和製造集成的獨特挑戰在領先的邊緣節點的電路。

承認的矽驗證的需要開發新的簽收準備流動,以確保第一時間對矽的成功,設置一個新鑄造流動的質量,範圍和相關標準。現在,客戶可以簽收準備使用業界最先進的合成,地點和路線的28nm的設計,註銷,並 DFM工具,工具腳本和方法。

“許多世界頂級的IC設計人員使用的是我們的28nm技術,提供明天的最具創新性的的移動和消費電子設備,Mojy赤岸,設計實現在GLOBALFOUNDRIES公司的高級副總裁說。” “通過與我們的合作夥伴提供一個全面的28nm設計平台的EDA / IP生態系統緊密合作,我們給客戶的信心,他們的設計將會給生活帶來順利和及時滿足他們的關鍵市場的需求。”

傳統的鑄造設計流程有沒有考慮到越來越多的設計和製造先進的技術節點的交互。 GLOBALFOUNDRIES已經解決這些問題,通過 EDA軟件供應商和IP對真正的矽驗證設計方法強調早期協同發展。除了與 GLOBALFOUNDRIES緊一體化“簽收物理驗證解決方案,所有的流量槓桿 GLOBALFOUNDRIES公司”作為一個在領導者的遺產設計的,製造設計(DFM)支持剛果(金)+,該公司的矽驗證的解決方案超出標準的設計規則檢查(剛果(金) ),並使用二維形狀為基礎的模式匹配,在不犧牲精度的前提下確定的複雜的製造問題,使100倍的速度提高。

GLOBALFOUNDRIES公司和Cadence聯合開發的28nm - SLP一個複雜的設計,充分體現了先進的矽實施的工具,包括高層次綜合,低功耗,路由,東風,並驗證了Cadence的組合。 9 mm2的數百萬門的設計架構,以突出和展示先進的28nm芯片實現技術,使定量的矽驗證的功率,性能,和面積之間進行折衷,以及穩定性和產量。被釋放的設計製造,並預計將在2011年上半年驗證的矽。將在2011年第一季度開始向客戶提供完整的設計,執行腳本,和28nm的路由和DFM推薦的方法白皮書。

GLOBALFOUNDRIES公司和Synopsys合作開發的28nm - SLP的設計流程基於 Synopsys的Galaxy™實施平台,一個插件的28nm - SLP代工就緒系統的Lynx設計系統的技術。的矽,經過驗證的設計流量集成與 Synopsys公司的最新的EDA技術,包括黃金時段 ®先進的芯片的變化分析,IC的編譯器的DFM -優化 Zroute路由器和式設計物理驗證,和集成電路驗證剛果(金)的的28nm - SLP的設計規則,GLOBALFOUNDRIES公司和剛果(金)+模式的支持。猞猁代工就緒系統適應山貓的銀河平台啟用生產設計流程GLOBALFOUNDRIES的技術,包括準則和工具設置的28nm矽的最新數據為基礎,以幫助確保最高的質量和最強大的設計。猞猁代工就緒系統解決建議的路由規則,芯片上的變化和先進的片上變異分析,和DFM,使一個更高效的切換與代工。預計將在2011年第一季度開始向客戶提供代工設計流量的28nm - SLP的山貓代工就緒系統。

GLOBALFOUNDRIES公司和Mentor Graphics公司正在開發一種基於奧林巴斯的SoC™的Calibre ® InRoute™產品的完整的參考設計流程。 GLOBALFOUNDRIES的的28nm - SLP技術的Olympus - SoC的路由器已經合格,既有先進的28nm的基本規則和建議的規則,以實施有效的路由的DFM,改進配方,製造得分分析(MAS)的支持提供支持。

GLOBALFOUNDRIES公司和Magma一直在努力制定一個渦的Talus ® IC實現平台為基礎的28nm - SLP簽收準備流。的Talus Vortex是建立在所有工藝節點,並在性能和電源管理是至關重要的的複雜的系統芯片(SoC)的工程師們的理想物理設計環境。它允許設計師實現了多達 1.5萬個單元格或多個大型設計或塊每天,極大地提高生產力 - 串音避免,先進的片上變異(AOCV)和多模式多邊角的分析的啟用。距骨還通過一個自動化的多VDD方法執行的先進的低功耗設計分析和優化。距骨已經使用Magma公司和GLOBALFOUNDRIES的共同的客戶,以滿足侵略性的時間,功率和性能指標。

GLOBALFOUNDRIES公司是聯合開發的28nm - SLP簽收準備流與 Apache的設計使用紅鷹™和圖騰™為客戶提供一個強大的解決方案,以滿足他們的低功耗要求的解決方案。鷹是經過驗證的電源簽收平台,為大規模的SoC,包括那些與超低功耗設計技術。圖騰提供電源,噪音和可靠性模擬 /混合信號設計的標誌。 Apache的產品在GLOBALFOUNDRIES的註銷流套件使設計者能夠進行早期原型,電路優化,和全芯片簽收。

在發展中國家所有這些先進的流量的一個先決條件是數字路由器嚴格的資格。 GLOBALFOUNDRIES公司已經開發出一套嚴格的要求,從 Cadence公司,Synopsys公司,Mentor Graphics公司和Magma數字路由器必須滿足以簽收準備合格。這包括物理驗證的簽收規則和建議的規則,運行時間和內存足跡,以及結果的質量。簽收準備流動和路由器資格是由來自 ARM的技工先進的28nm - SLP的物理IP,包括標準單元,功耗管理工具包,存儲器編譯器,和接口的IP的全套支持。

GLOBALFOUNDRIES的28nm的技術都採用門第一種方法的HKMG,這是優於其他晶圓代工的28nm技術在可伸縮性(性能,功耗,芯片尺寸,設計的兼容性)和可製造性。門的第一個解決方案股份的處理流程,設計的靈活性,設計元素和福利根據聚氮氧化矽閘所有以前的節點。

二,Cadence的高級副總裁兼首席營銷官John Bruggeman表示:“再次,Cadence已經與 GLOBALFOUNDRIES合作,以幫助我們共同的客戶解決他們最棘手的先進節點的挑戰,”。 “我們的矽實現技術,特別是Encounter數字實現(EDI)系統,使我們能夠發揮主導作用的28nm高K金屬門簽收就緒數字設計流程。本月底到年底的數字流利用統一,矽,證明的28nm路由的意圖,DFM的抽象和內置的簽收能力,能向另外提供可預見的矽銜接。,EDI系統的利用簽收的質量模式匹配技術,為客戶提供GLOBALFOUNDRIES公司的認證剛果(金)+固定,這 100多個,設計剛果(金)+比傳統的流動速度更快。“

“我們的過程中,設計和製造上的早期合作,使GLOBALFOUNDRIES公司和Synopsys公司提供全面的前端到後端生產驗證的28nm設計解決方案,基於 Synopsys的山貓設計系統,說:”約翰奇爾頓,市場營銷的高級副總裁兼戰略Synopsys公司的發展。 “”銀河實施綱要“的先進設計和物理驗證技術,以及預驗證的28nm SLP的山貓鑄造的準備系統,使領先的SoC設計團隊,以提供他們的下一代電源,智能手機和消費電子設備更有效和與整合的風險和成本相對較低。“

“實現的28nm簽收準備流動 GLOBALFOUNDRIES公司和Mentor之間的長期合作和相互投資的延續,”約瑟夫說 Sawicki,Mentor的設計矽司副總裁兼總經理。 “奧林巴斯,口徑和GLOBALFOUNDRIES的技術成一個無縫的流程,包括先進的DFM效應的考慮和優化整合,確保簽收準備的結果。該解決方案有助於雙方共同的客戶充分利用28nm工藝的能力,但仍保持或縮短設計週期。“

“支持的日益增加的性能,時間,到,市場和今天的片,智能電話,網絡和嵌入式設備中使用的28納米集成電路的功率最小化的要求先進的設計和製造技術,”說 Premal布赫,Magma公司的總經理設計實施業務部。 “GLOBALFOUNDRIES公司的28nm - SLP的工藝技術和Talus渦的結合提供了極快的低功耗設計吞吐量在28納米節點共同的客戶。”

“Apache的設計解決方案”的重點是為客戶提供的產品,解決功耗,噪音和可靠性的關鍵設計挑戰。該公司的行業證明簽署過的數字和定制的IC的電源供應噪音,電,遷移(EM),和靜電放電(ESD)的解決方案已經啟用了許多客戶,以預測和管理他們的設計電源相關的問題,“說殿楊,Apache的高級副總裁和總經理。 “Apache的GLOBALFOUNDRIES公司的28nm - SLP標誌過流合作將進一步確保我們共同的客戶,以滿足低功耗需求,實現矽成功。”

,ARM物理IP部門執行副總裁和總經理,“ARM Artisan物理IP平台為設計人員提供了一個廣泛的實施方案,以實現其低功耗的要求和處理器的性能目標,”西蒙說 Segars。 “EDA技術資格 Artisan物理IP和調整 GLOBALFOUNDRIES的製造過程中的IP地址是保證這些平台的重要組成部分,支持多樣化的SoC實現流經的無晶圓廠半導體產業。”

來源: http://www.globalfoundries.com/

Last Update: 7. October 2011 11:57

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