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GLOBALFOUNDRIES는 Synopsys' 65, 40 의 28 nm 가공 마디를 위한 IC Validator 증명합니다

Published on December 12, 2011 at 1:44 AM

Cameron 차이의

Synopsys는 그것의 물리적인 검증 제품, IC Validator가 GLOBALFOUNDRIES의 고객에게 배치 대 개략도와 디자인 규칙 검사 runsets에 즉시 접근가능성과 더불어 65, 40 및 28 nm 물리적인 방송 종료를 위한 GLOBALFOUNDRIES에 의해, 증명되었다는 것을 선언했습니다.

IC Validator 의 은하 실시 플래트홈의 분대는, 에서 디자인 물리적인 검증 실행을 위한 IC 컴파일러를 위한 적당한 분대이어, 수동 수선 및 늦게 단계 문제점을 피해서 tapeout 주기 시간을 감소시키는 장소와 경로 엔지니어를 가능하게 하. 증명서는 에서 디자인 물리 검증의 특별한 이점을 사용하기 위하여 GLOBALFOUNDRIES의 65, 40 그리고 28 nm 가공 기술 마디에 작동해 디자이너를 허용합니다.

그것의 커맨드 가공 엔진 및 팽창할 수 있는 잡종 데이터를 이용하여, IC Validator는 필요로 한 위로 및 오는 가공 마디를 위해 어려운 가장자리의와 다각형 기지를 둔 규칙 암호로 하고 평가하기를 위한 강한 플래트홈을 제안할 것입니다. 그것은 지루한 저수준 데이터의 가공을 자동화하고 더 높은 추상 수준에 암호로 하는 허용합니다. 그것의 가깝 선형 오를 수 있는 아키텍쳐는 기억 장치 알고 있는, 지 적이고, 부하 조정 및 계획의 이용을 통해 주류 기계설비 사용을 기술 낙관합니다. 이 특징은 디자인 규칙의 발달 그리고 응용을 경신하고 정교한 가공 마디에서 관련시킨 일반적인 고객에게 우량한 범위성 및 정확도를 제공하기 위하여 GLOBALFOUNDRIES를 돕습니다.

에서 디자인 물리적인 검증은 IC 컴파일러와 장소와 경로 엔지니어가 개정을 자동화하고 있는 동안 디자인의 완결 이전에 자동적인 방송 종료 질 분석을 실행하는 것을 허용하는 IC Validator의 화려한 조합입니다. 에서 디자인 기술은 빠른 ECO 타당성 검사와 같은 높 생산 기능을 타이밍 알고 있는 금속 충분한 양 및 자동적인 DRC 수선, 장소 안쪽에 모두 및 경로 준비 제공합니다. 에서 디자인 물리적인 검증은 하류 분석 툴의 높 비용 반복을 삭제하고 물리적인 방송 종료에 집중적인 디자인 전진을 유지합니다.

근원: http://www.synopsys.com

Last Update: 11. January 2012 06:03

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